参数资料
型号: ICS501DLF
厂商: INTEGRATED DEVICE TECHNOLOGY INC
元件分类: 时钟产生/分配
英文描述: 160 MHz, OTHER CLOCK GENERATOR, UUC
封装: DIE
文件页数: 3/4页
文件大小: 68K
代理商: ICS501DLF
ICS501
LOCO PLL Clock Multiplier
MDS 501 F
3
Revision 111000
Integrated Circuit Systems, Inc. 525 Race Street San Jose CA95126(408) 295-9800tel www.icst.com
Parameter
Conditions
Minimum
Typical
Maximum
Units
ABSOLUTE MAXIMUM RATINGS (stresses beyond these can permanently damage the device)
Supply Voltage, VDD
Referenced to GND
7
V
Inputs
Referenced to GND
-0.5
VDD+0.5
V
Clock Output
Referenced to GND
-0.5
VDD+0.5
V
Ambient Operating Temperature
0
70
C
ICS501MI only
-40
85
C
Soldering Temperature
Max of 10 seconds
260
C
Storage temperature
-65
150
C
DC CHARACTERISTICS (VDD = 5.0V unless otherwise noted)
Operating Voltage, VDD
3
5.5
V
Input High Voltage, VIH, ICLK only
ICLK (Pin 1)
(VDD/2)+1
VDD/2
V
Input Low Voltage, VIL, ICLK only
ICLK (Pin 1)
VDD/2
(VDD/2)-1
V
Input High Voltage, VIH
OE (Pin 7)
2
V
Input Low Voltage, VIL
OE (Pin 7)
0.8
V
Input High Voltage, VIH
S0, S1
VDD-0.5
V
Input Low Voltage, VIL
S0, S1
0.5
V
Output High Voltage, VOH
IOH=-25mA
2.4
V
Output Low Voltage, VOL
IOL=25mA
0.4
V
IDD Operating Supply Current, 20 MHz crystal No Load, 100MHz
20
mA
Short Circuit Current
CLK output
±70
mA
On-Chip Pull-up Resistor
Pin 7
270
k
Input Capacitance, S1, S0 , and OE
Pins 4, 6, 7
4
pF
AC CHARACTERISTICS (VDD = 5.0V unless otherwise noted)
Input Frequency, crystal input
5
27
MHz
Input Frequency, clock input
2
50
MHz
Output Frequency, VDD = 4.5 to 5.5V
0 C to +70 C
14
160
MHz
-40 C to +85 C
14
140
MHz
Output Frequency, VDD = 3.0 to 3.6V
0 C to +70 C
14
100
MHz
-40 C to +85 C
14
90
MHz
Output Clock Rise Time
0.8 to 2.0V
1
ns
Output Clock Fall Time
2.0 to 0.8V
1
ns
Output Clock Duty Cycle
1.5V, up to 160 MHz
45
49 to 51
55
%
PLL Bandwidth
10
kHz
Output Enable Time, OE high to output on
50
ns
Output Disable Time, OE low to tri-state
50
ns
Absolute Clock Period Jitter
Deviation from mean
±70
ps
One Sigma Clock Period Jitter
25
ps
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