参数资料
型号: ICS507-01-DWFLF
厂商: INTEGRATED DEVICE TECHNOLOGY INC
元件分类: 时钟产生/分配
英文描述: 200 MHz, OTHER CLOCK GENERATOR, UUC
封装: DIE
文件页数: 2/5页
文件大小: 62K
代理商: ICS507-01-DWFLF
ICS507-01
PECL Clock Synthesizer
MDS 507 H
2
Revision 092503
Integrated Circuit Systems, Inc. 525 Race Street San Jose CA 95126 (408)295-9800tel www.icst.com
Pin Assignment
Pin Descriptions
Key: I=Input, O=output, TI=tri-level input, P=power supply connection; XI, XO=crystal connections
Clock Multiplier Select Table
16
15
14
13
16 pin narrow (150 mil) SOIC
12
11
10
9
1
2
3
4
5
6
7
8
VDD
GND
X1/ICLK
VDD
S1
PECL
GND
NC
RES
NC
X2
S0
OE
NC
0 = connect pin directly to ground
1 = connect pin directly to VDD
M = leave unconnected (floating)
PECL
S1
S0
Multiplier
0
9.72X*
0
M
10X
0
1
12X
M
0
6.25X
M
8X
M
1
5X
1
0
2X
1
M
3X
1
4X
Number
Name
Type
Description
1
X1/ICLK
XI
Crystal or clock connection. Connect to a fundamental parallel mode crystal, or clock.
2
VDD
P
VDD. Connect to +3.3 V or +5 V, and to VDD on pin 3.
3
VDD
P
VDD. Connect to VDD on pin 2. Decouple with pin 5.
4
S1
TI
Multiplier select pin 1. Determines output frequency per table above.
5
GND
P
Connect to ground.
6
GND
P
Connect to ground.
7
NC
-
No connect. No internal connection.
8
PECL
O
PECL Output. Connect to resistor load as shown on page one.
9
PECL
O
Complementary PECL Output. Connect to resistor load as shown on page one.
10
RES
I
Bias Resistor Input. Connect a resistor between this pin and VDD.
11
NC
-
No connect. No internal connection.
12
NC
-
No connect. No internal connection.
13
OE
I
Output Enable. Tri-states both outputs when low. Internal pull-up.
14
S0
TI
Multiplier select pin 0. Determines output frequency per table above.
15
NC
-
No connect. No internal connection.
16
X2
XO
Crystal connection. Connect to crystal, or leave unconnected for clock input.
*For ICS 507-01 or ICS507-02
at 3.3V, use this selection to get
155.52 MHz from a 16 MHz
input.
For lowest phase noise
generation of 155.52 MHz, use
a 19.44 MHz crystal and the 8X
selection.
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PDF描述
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