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参数资料
| 型号： | ICS511MLF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 5/11页 |
| 文件大小： | 0K |
| 描述： | IC CLK MULTIPLIER PLL 8-SOIC |
| 产品培训模块： | Clock Distibution and Generation 1.0 |
| 标准包装： | 97 |
| 系列： | LOCO™ |
| 类型： | 时钟发生器 |
| PLL： | 是 |
| 输入： | 时钟，晶体 |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 200MHz |
| 除法器/乘法器： | 无/是 |
| 电源电压： | 3.135 V ~ 5.25 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 8-SOIC |
| 包装： | 管件 |
| 产品目录页面： | 1251 (CN2011-ZH PDF) |
| 其它名称： | 511MLF 800-1040 800-1040-5 800-1040-ND |
ICS511
LOCO PLL CLOCK MULTIPLIER
CLOCK MULTIPLIER
IDT / ICS LOCO PLL CLOCK MULTIPLIER
3
ICS511
REV K 051310
External Components
Decoupling Capacitor
As with any high-performance mixed-signal IC, the
ICS511 must be isolated from system power supply
noise to perform optimally.
A decoupling capacitor of 0.01F must be connected
between VDD and the GND. It must be connected close
to the ICS511 to minimize lead inductance. No external
power supply filtering is required for the ICS511.
Series Termination Resistor
A 33
terminating resistor can be used next to the CLK
pin for trace lengths over one inch.
Crystal Load Capacitors
The total on-chip capacitance is approximately 12 pF. A
parallel resonant, fundamental mode crystal should be
used. The device crystal connections should include
pads for small capacitors from X1 to ground and from
X2 to ground. These capacitors are used to adjust the
stray capacitance of the board to match the nominally
required crystal load capacitance. Because load
capacitance can only be increased in this trimming
process, it is important to keep stray capacitance to a
minimum by using very short PCB traces (and no vias)
between the crystal and device. Crystal capacitors, if
needed, must be connected from each of the pins X1
and X2 to ground.
The value (in pF) of these crystal caps should equal (CL
-12 pF)*2. In this equation, CL= crystal load capacitance
in pF. Example: For a crystal with a 16 pF load
capacitance, each crystal capacitor would be 8 pF
[(16-12) x 2] = 8.
6
S0
Tri-level Input
Select 0 for output clock. Connect to GND or VDD or float.
7
OE
Input
Output enable. Tri-states CLK output when low. Internal pull-up
resistor.
8
X2
Output
Crystal connection. Leave unconnected for clock input.
Pin
Number
Pin
Name
Pin
Type
Pin Description
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PDF描述 |
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参数描述 |
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