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参数资料
| 型号： | ICS524MILFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 2/7页 |
| 文件大小： | 0K |
| 描述： | IC CLK BUFFER 1:4 200MHZ 8-SOIC |
| 标准包装： | 1 |
| 系列： | ClockBlocks™ |
| 类型： | 扇出缓冲器（分配） |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:4 |
| 差分 - 输入:输出： | 无/无 |
| 输入： | 时钟 |
| 输出： | CMOS |
| 频率 - 最大： | 200MHz |
| 电源电压： | 2.375 V ~ 5.25 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 8-SOIC |
| 包装： | 标准包装 |
| 其它名称： | 800-2270-6 |
ICS524
LOW SKEW 1 TO 4 CLOCK BUFFER
FAN OUT BUFFER
IDT / ICS LOW SKEW 1 TO 4 CLOCK BUFFER
2
ICS524
REV C 021909
Pin Assignment
Pin Descriptions
External Components
A minimum number of external components are required for proper operation. A decoupling capacitor of 0.01 F
should be connected between VDD on pin 5 and GND on pin 8, as close to the device as possible. A 33
series
terminating resistor may be used on each clock output if the trace is longer than 1 inch.
To achieve the low output skew that the ICS524 is capable of, careful attention must be paid to board layout.
Essentially, all four outputs must have identical terminations, identical loads and identical trace geometries. If they
do not, the output skew will be degraded. For example, using a 30
series termination on one output (with 33 on
the others) will cause at least 15 ps of skew.
1
2
3
VD D
4
Q0
Q1
Q3
GND
Q2
ICLK
8
7
6
5
NC
8-pi n SO IC
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
ICLK
Input
Clock input, 5V tolerant input.
2
Q0
Output
Clock output 0.
3
Q1
Output
Clock output 1.
4
NC
—
Internal no connect.
5
VDD
Power
Connect to +2.5 V, +3.3 V or +5.0 V.
6
Q2
Output
Clock Output 2.
7
Q3
Output
Clock Output 3.
8
GND
Power
Connect to ground.
相关PDF资料 |
PDF描述 |
|---|---|
| VI-J32-MZ-F2 | CONVERTER MOD DC/DC 15V 25W |
| ICS553MILFT | IC CLK BUFFER 1:4 200MHZ 8-SOIC |
| ICS542MLFT | IC CLOCK BUFF DIVIDER 1:2 8-SOIC |
| VI-J33-MZ-F3 | CONVERTER MOD DC/DC 24V 25W |
| SI5330F-A00214-GM | IC CLK BUFFER TRANSLA 1:8 24-QFN |
相关代理商/技术参数 |
参数描述 |
|---|---|
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