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参数资料
| 型号： | ICS525R-02LFT |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 250 MHz, OTHER CLOCK GENERATOR, PDSO28 |
| 封装： | 0.150 INCH, ROHS COMPLIANT, MO-153, SSOP-28 |
| 文件页数： | 4/10页 |
| 文件大小： | 182K |
| 代理商： | ICS525R-02LFT |
OSCaRTM User Configurable Clock
MDS 525-01/02 Q
3
Revision 092209
Integrated Circuit Systems, Inc.
● 525 Race Street, San Jose, CA 95126 ● tel (408) 297-1201 ● www.icst.com
ICS525-01/02
KEY: I(PU) = Input with internal pull-up resistor; X1, X2 = crystal connections
ICS525-01 Maximum Output Frequency and Output Divider Table
ICS525-02 Maximum Output Frequency and Output Divider Table
8
X2
Crystal connection. Connect to a crystal or leave unconnected for clock.
9, 20
GND
Power
Connect to ground.
10 - 18
V0 - V8
I(PU)
VCO divider word input pins determined by user. Forms a binary number from 0 to
511.
19
PD
I(PU)
Power-down. Active low. Turns off entire chip when low. Clock outputs stop low.
21
CLK
Output
Output clock determined by status of R0-R6, V-V8, S0-S2, and input frequency.
22
REF
Output
Reference output. Buffered crystal oscillator (or clock ) output.
S2
Pin 5
S1
Pin 4
S0
Pin 3
CLK Output
Divider
Max Output Frequency (MHz)
VDD = 5 V
VDD = 3.3 V
0 - 70
° C
-40 to +85
° C
0 - 70
° C
-40 to +85
° C
00
0
10
26
23
18
16
0
1
2
160
140
100
90
0
1
0
8
40
36
25
22
0
1
4
80
72
50
45
1
0
5
50
45
34
30
1
0
1
7
40
36
26
23
1
0
9
33.3
30
20
18
1
6
53
47
27
24
S2
Pin 5
S1
Pin 4
S0
Pin 3
CLK Output
Divider
Max Output Frequency (MHz)
VDD = 5 V
VDD = 3.3 V
-40 to +85
° C -40 to +85 ° C
0
6
67
40
00
1
2
200
120
0
1
0
8
50
30
01
1
4
100
60
1
0
5
80
48
1
0
1
7
57
34
11
0
1
250
200
11
1
3
133
80
Pin
Number
Pin
Name
Pin
Type
Pin Description
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PDF描述 |
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