参数资料
型号: ICS542MILFT
厂商: IDT, Integrated Device Technology Inc
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文件大小: 0K
描述: IC CLOCK BUFF DIVIDER 1:2 8-SOIC
标准包装: 2,500
类型: 扇出缓冲器(分配),除法器
电路数: 1
比率 - 输入:输出: 1:2
差分 - 输入:输出: 无/无
输入: CMOS
输出: 三态,CMOS
频率 - 最大: 156MHz
电源电压: 3 V ~ 5.5 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 8-SOIC(0.154",3.90mm 宽)
供应商设备封装: 8-SOIC
包装: 带卷 (TR)
其它名称: 542MILFT
DATASHEET
CLOCK DIVIDER
ICS542
IDT / ICS CLOCK DIVIDER
1
ICS542
REV J 051310
Description
The ICS542 is cost effective way to produce a high-quality
clock output divided from a clock input. The chip accepts a
clock input up to 156 MHz at 3.3 V and produces a divide by
2, 4, 6, 8, 12, or 16 of the input clock. There are two outputs
on the chip, one being a low-skew divide by two of the other.
For instance, if an 100 MHz input clock is used, the ICS542
can produce low-skew 50 MHz and 25 MHz clocks, or low
skew 25 MHz and 12.5 MHz clocks. The chip has an
all-chip power-down mode that stops the outputs low, and
an OE pin that tri-states the outputs.
See the ICS541 and ICS543 for other clock dividers, and
the ICS501, 502, 511, 512, and 525 for clock multipliers.
Features
8-pin SOIC package, Pb free
Available in RoHS compliant package
IDT’s lowest cost clock divider
Low skew (500 ps) outputs. One is /2 of the other
Easy to use with other generators and buffers
Input clock frequency up to 156 MHz
Output clock duty cycle of 45/55
Power-down turns off chip
Output Enable
Advanced, low-power CMOS process
Operating voltage of 3.3 V or 5 V
Does not degrade phase noise - no PLL
Available in industrial and commercial temperature
ranges
Block Diagram
Input Clock
Divider
and
Selection
Circuitry
CLK1
CLK2
S1, S0
/2
OE (both outputs)
GND
VDD
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PDF描述
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