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参数资料
型号： ICS552R-01B
元件分类： 时钟及定时
英文描述： 552 SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20
封装： 0.150 INCH, SSOP-20
文件页数： 1/6页
文件大小： 132K
代理商： ICS552R-01B
ICS552-01B
MDS 552-01B E
1
Revision 012904
Integrated Circuit Systems, Inc.
● 525 Race Street, San Jose, CA 95126 ● tel (408) 297-1201 ● www.icst.com
Dual 1 to 4 High-Speed Clock Buffer
Description
The ICS552-01B is a low cost, high-speed clock buffer
which includes two identical single input to four output
buffers. By combining the two buffers on one monolithic
device, the propagation delays are matched through
the device, maintaining any skew relationship present
on the inputs. It is also possible to connect the inputs
together, creating a one-to-eight buffer. See the
ICS551M for a single 1 to 4 buffer in an 8-pin SOIC. For
more than eight outputs, see the MK74CBxxx Buffalo
series of clock drivers.
ICS also makes many PLL-based low-skew output
devices, as well as Zero Delay Buffers to synchronize
clocks. Contact ICS for all of your clocking needs.
Features
Packaged as 20-pin (150 mil) SSOP (QSOP)
Pb-free packaging available
Up to 200 MHz clock input/output at 3.3 V
Low skew of 250 ps maximum for any bank of four
Inputs can be connected together for a 1 to 8 buffer
with 250 ps skew between any outputs
3.0 V to 5.5 V operating voltage
Non-inverting
Ideal for networking clocks
Output Enable mode tri-states outputs
Full CMOS output swing with 25 mA output drive
capability at TTL levels
Advanced, low power, sub-micron CMOS process
Industrial temperature version available
Block Diagram
Control
Logic
INA
QA1
QB4
QB3
QB2
QB1
QA4
QA3
QA2
INB
S1
S0
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PDF描述
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参数描述
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