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参数资料
| 型号： | ICS557GI-05ALFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 8/12页 |
| 文件大小： | 0K |
| 描述： | IC CLK SOURCE QUAD DIFF 20TSSOP |
| 产品培训模块： | PCI-Express |
| 标准包装： | 1 |
| 系列： | PCI Express® (PCIe) |
| 类型： | 扩展频谱时钟发生器，扇出缓冲器（分配） |
| PLL： | 是 |
| 主要目的： | PCI Express（PCIe） |
| 输入： | 时钟，晶体 |
| 输出： | HCSL，LVDS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:4 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 200MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 20-TSSOP |
| 包装： | 标准包装 |
| 其它名称： | 800-2533-6 |
ICS557-05A
QUAD DIFFERENTIAL PCI-EXPRESS GEN1 CLOCK SOURCE
PCIE SSCG
IDT
QUAD DIFFERENTIAL PCI-EXPRESS GEN1 CLOCK SOURCE
5
ICS557-05A
REV O 112111
Output Structures
General PCB Layout Recommendations
For optimum device performance and lowest output phase
noise, the following guidelines should be observed.
1. Each 0.01F decoupling capacitor should be mounted on
the component side of the board as close to the VDD pin as
possible.
2. No vias should be used between decoupling capacitor
and VDD pin.
3. The PCB trace to VDD pin should be kept as short as
possible, as should the PCB trace to the ground via.
Distance of the ferrite bead and bulk decoupling from the
device is less critical.
4. An optimum layout is one with all components on the
same side of the board, minimizing vias through other signal
layers (any ferrite beads and bulk decoupling capacitors can
be mounted on the back). Other signal traces should be
routed away from the ICS557-05A.This includes signal
traces just underneath the device, or on layers adjacent to
the ground plane layer used by the device.
R
R 475
6*IREF
=2.3 mA
IREF
See Output Termination
Sections - Pages 3 ~ 5
Ω
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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