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参数资料
| 型号： | ICS558G-01LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/6页 |
| 文件大小： | 0K |
| 描述： | IC CLK BUFF DVDR MUX 2:4 16TSSOP |
| 标准包装： | 96 |
| 系列： | ClockBlocks™ |
| 类型： | 扇出缓冲器（分配），除法器，多路复用器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:4 |
| 差分 - 输入:输出： | 是/无 |
| 输入： | CMOS，PECL |
| 输出： | 三态，CMOS |
| 频率 - 最大： | 250MHz |
| 电源电压： | 2.375 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 管件 |
| 其它名称： | 558G-01LF 800-2371-5 ICS558G-01LF-ND |
DATASHEET
PECL/CMOS TO CMOS CLOCK DRIVER
ICS558-01
IDT / ICS PECL/CMOS TO CMOS CLOCK DRIVER
1
ICS558-01
REV F 051310
Description
The ICS558-01 accepts a high speed input of either PECL
or CMOS, integrates a divider of 1, 2, 3, or 4, and provides
four CMOS low skew outputs. The chip also has output
enables so that one, three, or all four outputs can be
tri-stated.
The ICS558-01 is a member of the IDT Clock Blocksfamily
of clock generation, synchronization, and distribution
devices.
Features
16-pin TSSOP package
Pb (lead) free package
Selectable PECL or CMOS inputs
Operates up to 250 MHz
Works as a voltage translator
Four low skew (<250 ps) outputs
Selectable internal divider
Operating input voltages of 3.3 V or 5.0 V
Operating output voltages of 2.5 V, 3.3 V or 5.0 V
Ideal for IA64 designs
Block Diagram
OE1
CLK1
CLK2
CLK3
CLK4
PECLIN
Output Divide
PECLIN
S0, S1
GND
VDDP
OE0
GND
VDDC
2
1
0
CMOSIN
SELPECL
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