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参数资料
| 型号： | ICS580M-01 |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 580 SERIES, LOW SKEW CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16 |
| 封装： | 0.150 INCH, SOIC-16 |
| 文件页数： | 2/9页 |
| 文件大小： | 198K |
| 代理商： | ICS580M-01 |
ICS580-01
GLITCH-FREE CLOCK MULITPLEXER
CLOCK MULTIPLEXER
IDT / ICS GLITCH-FREE CLOCK MULITPLEXER
2
ICS580-01
REV F 110806
Pin Assignment
Timeout Selection
Pin Descriptions
12
1
11
2
10
3
9
SELB
4
DIV
5
VDDI
6
VDDC
7
INA
8
INB
CLK1
CLK2
NO_INA
GND
NO_INB
OE2
OE4
GND
16
15
14
13
OE3
OE1
16 pin (150 mil) SOIC
DIV
Nominal Timeout
0
600 ns
1
75 ns
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
SELB
Input
Mux select. Selects INB when high. Internal pull-up.
2
DIV
Input
Time out select. See table above. Internal pull-up.
3
VDDI
Power
Supply for input clocks only. Can be higher than VDDC.
4
INA
Input
Input Clock A.
5
INB
Input
Input Clock B.
6
GND
Power
Connect to ground.
7
OE4
Input
Output enable. Tri-states NO_INB when low. Internal pull-up.
8
OE3
Input
Output enable. Tri-states NO_INA when low. Internal pull-up.
9
OE2
Input
Output enable. Tri-states CLK2 when low. Internal pull-up.
10
GND
Power
Connect to ground.
11
NO_INB
Output
Goes high when clock on INB stops.
12
NO_INA
Output
Goes high when clock on INA stops.
13
CLK2
Output
Clock 2 output. Low skew compared to CLK1.
14
CLK1
Output
Clock 1 output. Low skew compared to CLK2.
15
VDDC
Power
Main chip supply. Output clocks amplitude will match this VDD.
16
OE1
Input
Output enable. Tri-states CLK1 when low. Internal pull-up.
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PDF描述 |
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