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参数资料
| 型号： | ICS580M-01ILF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 8/13页 |
| 文件大小： | 0K |
| 描述： | IC CLK MUX ZERO DLAY BUFF 16SOIC |
| 产品培训模块： | Clock Distibution and Generation 1.0 |
| 标准包装： | 48 |
| 类型： | 多路复用器，零延迟缓冲器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 无/无 |
| 输入： | 时钟 |
| 输出： | 时钟 |
| 频率 - 最大： | 270MHz |
| 电源电压： | 2.5 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 16-SOIC |
| 包装： | 管件 |
| 产品目录页面： | 1252 (CN2011-ZH PDF) |
| 其它名称： | 580M-01ILF 800-1077 800-1077-5 800-1077-ND |
ICS580-01
GLITCH-FREE CLOCK MULITPLEXER
CLOCK MULTIPLEXER
IDT / ICS GLITCH-FREE CLOCK MULITPLEXER
4
ICS580-01
REV L 051310
Device Operation
The ICS580-01 consists of a glitch free mux between INA and INB controlled by SELB. The device is designed to
switch between two clocks, whether running or not. In the first example, clocks are running on both INA and INB.
When SELB changes, the output clock goes low after three cycles of the output clock (nominally). The output then
stays low for three cycles of the new input clock (nominally) and then starts with the new input clock. This is shown
in Figure 1.
In the second example, one of the inputs was selected and running but has since stopped (either high or low). This
is indicated by either NO_INA or NO_INB going high depending on whether INA or INB has stopped. These signals
go high following a selectable time-out period after the clock has stopped. The timeout period is determined by the
DIV input in. The SELB pin is now changed to select the new input clock which is running. The output clock
immediately goes low and stays low for three cycles of the new input clock and then starts with the new input clock.
Figure 2 shows an example of this
INA
INB
SELB
CLK1, 2
Figure 1
INA
INB
SELB
NO_INA
Figure 2
Timeout
CLK1, 2
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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