参数资料
型号: ICS580M-01LF
厂商: IDT, Integrated Device Technology Inc
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文件大小: 0K
描述: IC CLK MUX ZERO DLAY BUFF 16SOIC
产品培训模块: Clock Distibution and Generation 1.0
标准包装: 48
类型: 多路复用器,零延迟缓冲器
电路数: 1
比率 - 输入:输出: 2:2
差分 - 输入:输出: 无/无
输入: 时钟
输出: 时钟
频率 - 最大: 270MHz
电源电压: 2.5 V ~ 5.5 V
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 16-SOIC(0.154",3.90mm 宽)
供应商设备封装: 16-SOIC
包装: 管件
其它名称: 580M-01LF
800-1078
800-1078-5
800-1078-ND
ICS580-01
GLITCH-FREE CLOCK MULITPLEXER
CLOCK MULTIPLEXER
IDT / ICS GLITCH-FREE CLOCK MULITPLEXER
5
ICS580-01
REV L 051310
Application Example
In the third example, the ICS580-01 is configured to automatically switch clocks when an input stops. The clock that
could stop is connected to INA while the backup clock (always running) is connected to INB. The output NO_INA is
connected to SELB. This means that when the clock on INA stops, NO_INA goes high selecting the clock on INB
which is muxed to the output after three cycles. When the clock on INA restarts, NO_INA immediately goes low,
selecting the clock on INA. The output then switches in the manner described in the first example.
The circuit diagram in Figure 3 shows a typical connection for this example. Note that CLK2 and NO_INB are
unused and are disabled by grounding OE2 and OE4. A 33
series termination resistor is used on the clock output
and two decoupling capacitors of 0.01
F are used. All other inputs are left floating and are therefore pulled high by
the on-chip pull-ups.
Output Enable
Each output has a dedicated output enable pin. If an output is unused, it should be tri-stated by tying the
appropriate output enable pin to ground.
External Components
The ICS580-01 requires two 0.01
F decoupling capacitors, one between VDDI and GND and one between VDDC
and GND. Series termination resistors of 33
can be used on CLK1 and CLK2.
NO_INA
SELB
NO_INB
DIV
GND
VDDI
OE2
INA
INB
GND
OE4
OE3
OE1
VDDC
CLK1
CLK2
VDD
0.01
F
33
0.01
F
Normal Clock
Backup Clock
Output Clock
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