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参数资料
| 型号： | ICS613MLF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 157.5 MHz, OTHER CLOCK GENERATOR, PDSO16 |
| 封装： | 0.150 INCH, LEAD FREE, SOIC-16 |
| 文件页数： | 2/7页 |
| 文件大小： | 230K |
| 代理商： | ICS613MLF |
LOW PHASE NOISE CLOCK MULTIPLIER
MDS 613 C
2
Revision 111204
Integrated Circuit Systems, Inc.
● 525 Race Street, San Jose, CA 95126 ● tel (408) 297-1201 ● www.icst.com
ICS613
Pin Assignment
Clock Select Table
Pin Descriptions
12
1
11
2
10
3
9
X1/IC LK
4
S0
5
S2
6
S1
7
VD D
8
GN D
VD D
GN D
V DDO 2
V DDO 1
GN D
CLK 2
CLK 1
16
15
14
13
GN D
X2
16 P in (150 m il) S O IC
S2
S1
S0
Input
Output (CLK1
and CLK2)
0
25
125
0
1
25
156.25
0
1
0
25
143.75
0
1
25
150
1
0
25
146.875
1
0
1
25
157.5
1
0
25
140
1
25
156.25
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
XI/ICLK
Input
Crystal Connection. Connect to a 25 MHz crystal or clock.
2
S0
Input
Select pin 0. Internal pull-down.
3
S2
Input
Select pin 2. Internal pull-down.
4
VDD
Power
Connect to +3.3V. Must be the same as pin 13.
5
GND
Power
Connect to ground.
6
VDDO2
Power
Output VDD for CLK2. Connect to either +2.5V or +3.3V.
7
CLK2
Output
CLK2 output. Frequency based on table above.
8
GND
Power
Connect to ground.
9
GND
Power
Connect to ground.
10
CLK1
Output
CLK1 output. Frequency based on table above.
11
VDDO1
Power
Output VDD for CLK1. Connect to either +2.5V or +3.3V.
12
GND
Power
Connect to ground.
13
VDD
Power
Connect to +3.3V. Must be the same as pin 4.
14
GND
Power
Conenct to ground.
15
S1
Input
Select pin 1. Internal pull-up.
16
X2
Input
Crystal Connection. Connect to a 25 MHz crystal. Leave
unconnected for clock input.
ICS613
LOW PHASE NOISE CLOCK MULTIPLIER
TSD
IDT / ICS LOW PHASE NOISE CLOCK MULTIPLIER
ICS613
2
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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