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参数资料
| 型号： | ICS662M-02LFTR |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8 |
| 封装： | 0.150 INCH, SOIC-8 |
| 文件页数： | 2/6页 |
| 文件大小： | 97K |
| 代理商： | ICS662M-02LFTR |
NTSC/PAL AUDIO CLOCK
MDS 662-02 A
2
Revision 100803
Int e gr ated C i rcui t S ystems l 525 Ra ce S t re et, Sa n Jose, C A 951 26 l t e l (408) 295-9 800 l w w w. i cst . c om
ICS662-02
Pin Assignment
8 pin (150 mil) SOIC
CLOCK OUTPUT SELECT TABLE
* -0.16 ppm compared to PAL specification
Pin Descriptions
REF
VDD
GND
OE/PD
S2
S1
CLK
S0
1
2
3
4
8
7
6
5
S2
S1
S0
Input
Frequency
Output
Frequency
Video
Std.
00
0
14.31818
8.192
NTSC
00
1
14.31818
11.2896
NTSC
01
0
14.31818
12.288
NTSC
01
1
14.31818
24.576
NTSC
1
0
17.73447205*
8.192
PAL
1
0
1
17.73447205*
11.2896
PAL
1
0
17.73447205*
12.288
PAL
1
17.73447205*
24.576
PAL
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
REF
Input
Reference clock input.
2
VDD
Power
Connect to +3.3 V.
3
GND
Power
Connect to ground.
4
S2
Input
Output frequency selection Pin 2. Determines output frequency as per
table above.
5
CLK
Output
Clock output per table above.
6
S1
Input
Output frequency selection Pin 1. Determines output frequency as per
table above.
7OE/PD
Input
Output enable. Powers down PLL and tri-states output with weak
pull-down when low.
8
S0
Input
Output frequency selection Pin 0. Determines output frequency as per
table above.
相关PDF资料 |
PDF描述 |
|---|---|
| ICS662M-02LFTR | PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8 |
| ICS662M-02LF | PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8 |
| ICS662M-02TR | PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8 |
| ICS662M-03LF | 662 SERIES, PLL BASED CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8 |
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相关代理商/技术参数 |
参数描述 |
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