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参数资料
| 型号： | ICS671M-01T |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 671 SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16 |
| 封装： | 0.150 INCH, SOIC-16 |
| 文件页数： | 2/7页 |
| 文件大小： | 244K |
| 代理商： | ICS671M-01T |
ZERO DELAY, LOW SKEW BUFFER AND MULTIPLIER
MDS 671-01 D
2
Revision 041105
Integrated Circuit Systems l 525 Race Street, San Jose, CA 95126 l tel (408) 297-1201 l
www.icst.com
ICS671-01
Pin Assignment
Output Clock Mode Select Table
Note 1. Outputs are in high impedence state
Note 2: In S1:S0 = 01 Mode, only the x1 output on CLK 8 will be zero delay. The x2 and x5 outputs can power-up
in different states so the skew relationship is not defined.
Pin Descriptions
12
1
11
2
10
CL K IN
FB IN
3
9
CL K 1
4
CL K 2
CL K 8
5
VD D
6
CL K 7
7
GN D
8
CL K 3
VD D
GN D
CL K 6
CL K 4
CL K 5
S0
S1
16
15
14
13
16 pin na rrow (150 m il) S O IC
S1
S0
CLK1:6
CLK7
CLK8
Input Range
0
Tri-state (note 1)
-
0
1
x2 (note 2)
x5 (note 2)
x1
5 to 30 MHz
1
0
x2
15 to 80 MHz
1
x4
7.5 to 40 MHz
Pin
Number
Pin
Name
Pin Type
Pin Description
1
CLKIN
Input
Clock input.
2-3, 6-7, 10-11
CLK1:6
Output
Clock outputs 1:6. See table above.
4
VDD
Power
Power supply. Connect both pins to the same voltage (either 3.3V or 5V).
5
GND
Power
Connect to ground.
8
S0
Input
Select input 0. See table above.
9
S1
Input
Select input 1. See table above.
12
GND
Power
Connect to ground.
13
VDD
Power
Power supply. Connect both pins to the same voltage (either 3.3V or 5V).
14
CLK7
Output
Clock output 7. See table above.
15
CLK8
Output
Clock output 8. See table above. Normally use this clock as feedback.
16
FBIN
Input
Feedback input. Connect to CLK8 under normal operations.
ICS671-01
ZERO DELAY, LOW SKEW BUFFER AND MULTIPLIER
TSD
IDT / ICS ZERO DELAY, LOW SKEW BUFFER AND MULTIPLIER
ICS671-01
2
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