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参数资料
| 型号： | ICS671M-02ILF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16 |
| 封装： | 0.150 INCH, SOIC-16 |
| 文件页数： | 2/4页 |
| 文件大小： | 63K |
| 代理商： | ICS671M-02ILF |
ICS671-02
3.3 Volt Zero Delay, Low Skew Buffer
MDS 671-02
2
Revision 111400
Integrated Circuit Systems, Inc. 525 Race Street San Jose CA95126 (408) 295-9800 tel www.icst.com
ADVANCE INFORMATION
Pin Descriptions
Key: I = Input; O = output; P = power supply connection. Outputs have a weak internal pull-down when in
tri-state mode.
Pin Assignment
ICS671-02
External Components
The ICS671-02 requires a minimum number of external components for proper operation. Decoupling
capacitors of 0.01F should be connected between VDD and GND on pins 4 and 5, and VDD and GND
on pins 13 and 12, as close to the device as possible. A series termination resistor of 33
may be used close
to each clock output pin to reduce reflections.
16
15
14
13
16 pin narrow (150 mil) SOIC
12
11
10
9
1
2
3
4
5
6
7
8
CLKA1
GND
FBIN
CLKIN
VDD
S2
CLKB1
CLKB2
VDD
GND
CLKB3
S1
CLKB4
CLKA4
CLKA3
CLKA2
Number
Name
Type
Description
1
CLKIN
I
Clock Input. (5 V tolerant)
2, 3, 14, 15
CLKA1:A4
O
Clock Outputs A1:A4. See above table.
4, 13
VDD
P
Power supply. Connect both pins to same voltage (3.3 V).
5, 12
GND
P
Connect to ground.
6, 7, 10, 11
CLKB1:B4
O
Clock Outputs B1:B4. See above table.
8
S2
I
Select input 2. See table above. Internal pull-up.
9
S1
I
Select input 1. See table above. Internal pull-up.
16
FBIN
I
Feedback Input. Connect to any output under normal operation. (5 V tolerant)
S2
S1
CLKA1:A4
CLKB1:B4
A & B Source
PLL Status
0
Tri-state (high impedance)
PLL
ON
0
1
Stopped Low
none
OFF
1
0
Running
CLKIN*
OFF
1
Running
PLL
ON
Output Clock Mode Select Table
*Note: Buffer mode only; not zero delay between input and output.
相关PDF资料 |
PDF描述 |
|---|---|
| ICS671M-02I | PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16 |
| ICS671M-02ILF | PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16 |
| ICS671M-02IT | PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16 |
| ICS671M-03IT | 671 SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16 |
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参数描述 |
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| ICS671M-03IT | 功能描述:IC BUFFER/MULT ZD 16-SOIC RoHS:否 类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器 系列:- 产品变化通告:Product Discontinuation 04/May/2011 标准包装:96 系列:- 类型:时钟倍频器，零延迟缓冲器 PLL:带旁路 输入:LVTTL 输出:LVTTL 电路数:1 比率 - 输入:输出:1:8 差分 - 输入:输出:无/无 频率 - 最大:133.3MHz 除法器/乘法器:是/无 电源电压:3 V ~ 3.6 V 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:16-TSSOP（0.173"，4.40mm 宽） 供应商设备封装:16-TSSOP 包装:管件 其它名称:23S08-5HPGG |
| ICS671M-06I | 制造商:ICS 制造商全称:ICS 功能描述:3.3 VOLT ZERO DELAY, LOW SKEW BUFFER |
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