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参数资料
| 型号： | ICS674R-01LF |
| 元件分类： | 标准逻辑 |
| 英文描述： | SPECIALTY LOGIC CIRCUIT, PDSO28 |
| 封装： | 0.150 INCH, LEAD FREE, SSOP-28 |
| 文件页数： | 6/7页 |
| 文件大小： | 168K |
| 代理商： | ICS674R-01LF |
USER CONFIGURABLE DIVIDER
MDS 674-01 E
6
Revision 082305
Integrated Circuit Systems l 525 Race Street, San Jose, CA 95126 l tel (408) 297-1201 l
www.icst.com
ICS674-01
AC Electrical Characteristics
VDD = 5 V, Ambient Temperature -40 to +85
°C, CLOAD at CLK = 15 pF, unless stated otherwise
1 The duty cycle of OUTA is dependent on the selected divide. This because OUTA goes low for 2 input
clock cycles on INA. For example, if a divide of 20 is selected, the duty cycle will be 90%. Simlarly, if PD=1
is selected for OUTB, the duty cycle will be dependent on the selected divide. In this case, OUTB goes high
for approximately 8 input clock cycles on INB.
Short Circuit Current
IOS
Each output
±70
mA
On-Chip Pull-up Resistor
RPU
A, B, S select pins
270
k
Input Capacitance
CIN
A, B, S select pins
5
pF
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Parameter
Symbol
Conditions
Min.
Typ.
Max. Units
Input Frequency, Divider A
fIN
3.3 V
0
135
MHz
Input Frequency, Divider B
3.3 V
0
180
MHz
Input Frequency, Divider A
5 V
0
200
MHz
Input Frequency, Divider B
5 V
0
235
MHz
Input Frequency, Divider A
(Industrial temperature)
fIN
at 3.3 V, +85
°C0
125
MHz
Input Frequency, Divider B
(Industrial temperature)
at 3.3 V, +85
°C0
170
MHz
Input Frequency, Divider A
(Industrial temperature)
at 5 V, +85
°C0
190
MHz
Input Frequency, Divider B
(Industrial temperature)
at 5 V, +85
°C0
220
MHz
Output Rise Time
tOR
20% to 80%
1.5
ns
Output Fall Time
tOF
80% to 20%
1.5
ns
OUTB Clock Duty Cycle1
tDC
at VDD/2
45
49 to 51
55
%
OUTB Clock Duty Cycle
odd post dividers
at VDD/2, except PD=1
40
60
%
OUTA Clock Duty Cycle1
at VDD/2
20
98.5
%
Peak-to-Peak Jitter
15 pF
400
ps
Cycle-to-Cycle Jitter
30 pF loads
300
ps
Propagation Delay,
Divider A
TPA
VDD = 3.3 V, +25
°C6.5
ns
VDD = 5.0 V, +25
°C4.5
ns
Propagation Delay,
Divider B + Post Divider
TPB
VDD = 3.3 V, +25
°C20
ns
VDD = 5.0 V, +25
°C13
ns
相关PDF资料 |
PDF描述 |
|---|---|
| ICS674R-01LFT | SPECIALTY LOGIC CIRCUIT, PDSO28 |
| ICS674R-01IT | SPECIALTY LOGIC CIRCUIT, PDSO28 |
| ICS674R-01ILFT | SPECIALTY LOGIC CIRCUIT, PDSO28 |
| ICS674R-01ILF | SPECIALTY LOGIC CIRCUIT, PDSO28 |
| ICS726T | 36 MHz, OTHER CLOCK GENERATOR, PDSO6 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| ICS674R-01LFT | 功能描述:IC DIVIDER USER CONFIG 28-SSOP RoHS:是 类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器 系列:- 标准包装:2,000 系列:- 类型:PLL 时钟发生器 PLL:带旁路 输入:LVCMOS，LVPECL 输出:LVCMOS 电路数:1 比率 - 输入:输出:2:11 差分 - 输入:输出:是/无 频率 - 最大:240MHz 除法器/乘法器:是/无 电源电压:3.135 V ~ 3.465 V 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:32-LQFP 供应商设备封装:32-TQFP（7x7） 包装:带卷 (TR) |
| ICS674R-01T | 功能描述:IC DIVIDER USER CONFIG 28-SSOP RoHS:否 类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器 系列:- 产品变化通告:Product Discontinuation 04/May/2011 标准包装:96 系列:- 类型:时钟倍频器，零延迟缓冲器 PLL:带旁路 输入:LVTTL 输出:LVTTL 电路数:1 比率 - 输入:输出:1:8 差分 - 输入:输出:无/无 频率 - 最大:133.3MHz 除法器/乘法器:是/无 电源电压:3 V ~ 3.6 V 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:16-TSSOP（0.173"，4.40mm 宽） 供应商设备封装:16-TSSOP 包装:管件 其它名称:23S08-5HPGG |
| ICS680-01 | 制造商:ICS 制造商全称:ICS 功能描述:Networking Clock Synthesizer and Zero Delay Buffer |
| ICS680G-01 | 功能描述:IC SYNTHESIZER/ZD BUFFER 24TSSOP RoHS:否 类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器 系列:- 产品变化通告:Product Discontinuation 04/May/2011 标准包装:96 系列:- 类型:时钟倍频器，零延迟缓冲器 PLL:带旁路 输入:LVTTL 输出:LVTTL 电路数:1 比率 - 输入:输出:1:8 差分 - 输入:输出:无/无 频率 - 最大:133.3MHz 除法器/乘法器:是/无 电源电压:3 V ~ 3.6 V 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:16-TSSOP（0.173"，4.40mm 宽） 供应商设备封装:16-TSSOP 包装:管件 其它名称:23S08-5HPGG |
| ICS680G-01LF | 功能描述:IC SYNTHESIZER/ZD BUFFER 24TSSOP RoHS:是 类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器 系列:- 标准包装:1,000 系列:- 类型:时钟/频率合成器，扇出分配 PLL:- 输入:- 输出:- 电路数:- 比率 - 输入:输出:- 差分 - 输入:输出:- 频率 - 最大:- 除法器/乘法器:- 电源电压:- 工作温度:- 安装类型:表面贴装 封装/外壳:56-VFQFN 裸露焊盘 供应商设备封装:56-VFQFP-EP（8x8） 包装:带卷 (TR) 其它名称:844S012AKI-01LFT |
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