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参数资料
| 型号： | ICS810251AGI |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 25 MHz, OTHER CLOCK GENERATOR, PDSO16 |
| 封装： | 4.40 X 5 MM, 0.925 MM HEIGHT, MO-153, TSSOP-16 |
| 文件页数： | 8/13页 |
| 文件大小： | 2081K |
| 代理商： | ICS810251AGI |
ICS810251I
VCXO AND SYNCHRONOUS ETHERNET JITTER ATTENUATOR
PRELIMINARY
IDT / ICS VCXO AND JITTER ATTENUATOR
4
ICS810251AGI REV. A NOVEMBER 14, 2007
Table 3C. LVCMOS/LVTTL DC Characteristics, VDD = VDDO = 3.3V ± 5% or 2.5V ± 5%, TA = -40°C to 85°C
NOTE 1: Outputs terminated with 50
to V
DDO/2. See Parameter Measurement Information section. Load Test Circuit diagrams.
AC Electrical Characteristics
Table 4A. AC Characteristics, VDD = VDDO = 3.3V ± 5%, TA = -40°C to 85°C
NOTE 1: This parameter is defined in accordance with JEDEC Standard 65.
NOTE 2: Please refer to the Phase Noise Plot.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
VIH
Input
High Voltage
VDD = 3.465V
2
VDD + 0.3
V
VDD = 2.625V
1.7
VDD + 0.3
V
VIL
Input
Low Voltage
VDD = 3.465V
-0.3
0.8
V
VDD = 2.625V
-0.3
0.7
V
IIH
Input
High Current
CLK_IN
VDD = VIN = 3.465V or 2.625V
150
A
OE, PLL_SEL
VDD = VIN = 3.465V or 2.625V
5
A
IIL
Input
Low Current
CLK_IN
VDD = 3.465V or 2.625V, VIN = 0V
-5
A
OE, PLL_SEL
VDD = 3.465V or 2.625V, VIN = 0V
-150
A
VOH
Output High Voltage; NOTE 1
VDDO = 3.3V ± 5%
2.6
V
VDDO = 2.5V ± 5%
1.8
V
VOL
Output Low Voltage; NOTE 1
VDDO = 3.3V ± 5% or 2.5V ± 5%
0.5
V
Parameter
Symbol
Test Conditions
Minimum
Typical
Maximum
Units
fREF
Input Reference Frequency
25
MHz
125
MHz
fVCO
VCXO-PLL Frequency Range
25
MHz
fOUT
Output Frequency
25
MHz
tJIT(CC)
Cycle-to-Cycle Jitter; NOTE 1
TBD
ps
tjit
RMS Phase Jitter (Random);
NOTE 2
Integration Range:
12kHz – 10MHz
(fOUT = 25MHz)
0.22
1
ps
tJIT(PER)
Period jitter
TBD
ps
tR / tF
Output Rise/Fall Time
20% to 80%
845
ps
odc
Output Duty Cycle
45
50
55
%
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