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参数资料
| 型号： | ICS8344BYILFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/16页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK BUFFER MUX 2:24 48-LQFP |
| 标准包装： | 1,000 |
| 系列： | HiPerClockS™ |
| 类型： | 扇出缓冲器（分配），多路复用器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:24 |
| 差分 - 输入:输出： | 是/无 |
| 输入： | HCSL，LVDS，LVHSTL，LVPECL，SSTL |
| 输出： | LVCMOS，LVTTL |
| 频率 - 最大： | 100MHz |
| 电源电压： | 2.375 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-LQFP |
| 供应商设备封装： | 48-TQFP（7x7） |
| 包装： | 带卷 (TR) |
| 其它名称： | 8344BYILFT |
LOW SKEW, 1-TO-24 DIFFERENTIAL-
TO-LVCMOS/LVTTL FANOUT BUFFER
ICS8344I
IDT / ICS LVCMOS/LVTTL FANOUT BUFFER
1
ICS8344BYI REV. B February 20, 2009
GENERAL DESCRIPTION
The ICS8344I is a low voltage, low skew fanout
buffer and a member of the HiPerClockS fam-
ily of High Performance Clock Solutions from IDT.
The ICS8344I has two selectable clock inputs.
The CLK0, nCLK0 and CLK1, nCLK1 pairs can
accept most standard differential input levels. The ICS8344I
is designed to translate any differential signal levels to
LVCMOS/LVTTL levels. The low impedance LVCMOS/LVTTL
outputs are designed to drive 50
Ω series or parallel termi-
nated transmission lines. The effective fanout can be in-
creased to 48 by utilizing the ability of the outputs to drive
two series terminated lines. Redundant clock applications
can make use of the dual clock input. The dual clock inputs
also facilitate board level testing. ICS8344I is character-
ized at full 3.3V, full 2.5V and mixed 3.3V input and 2.5V
output operating supply modes.
Guaranteed output and part-to-part skew characteristics make
the ICS8344I ideal for those clock distribution applications de-
manding well defined performance and repeatability.
FEATURES
Twenty-four LVCMOS/LVTTL outputs,
7
Ω typical output impedance
Two selectable differential clock input pairs for redundant
clock applications
CLKx, nCLKx pair can accept the following differential
input levels: LVDS, LVPECL, LVHSTL, SSTL, HCSL
Maximum output frequency: 100MHz
Translates any single-ended input signal to LVCMOS/LVTTL
with resistor bias on nCLK input
Multiple output enable pins for disabling unused outputs
in reduced fanout applications
Output skew: 275ps (maximum)
Part-to-part skew: 600ps (maximum)
Bank skew: 150ps (maximum)
Supply modes:
Core/Output
3.3V/3.3V
3.3V/2.5V
2.5V/2.5V
-40°C to 85°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
BLOCK DIAGRAM
PIN ASSIGNMENT
HiPerClockS
ICS
48 47 46 45 44 43 42 41 40 39 38 37
13 14 15 16 17 18 19 20 21 22 23 24
1
2
3
4
5
6
7
8
9
10
11
12
36
35
34
33
32
31
30
29
28
27
26
25
Q16
Q17
VDDO
GND
Q18
Q19
Q20
Q21
VDDO
GND
Q22
Q23
Q7
Q6
VDDO
GND
Q5
Q4
Q3
Q2
VDDO
GND
Q1
Q0
OE1
OE2
OE3
CLK0
nCLK0
V
DD
GND
CLK1
nCLK1
V
DD
GND
CLK_SEL
Q8
Q9
V
DDO
GND
Q10
Q11
Q12
Q13
V
DDO
GND
Q14
Q1
5
CLK0
nCLK0
OE1
OE2
OE3
Q0:Q7
Q8:Q15
Q16:Q23
CLK_SEL
CLK1
nCLK1
48-Lead LQFP
7mm x 7mm x 1.4mm
package body
Y Package
Top View
ICS8344I
0
1
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PDF描述 |
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参数描述 |
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