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参数资料
| 型号： | ICS83904AG-02LFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/9页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK BUFFER MUX 3:4 16-TSSOP |
| 标准包装： | 2,500 |
| 系列： | HiPerClockS™ |
| 类型： | 扇出缓冲器（分配），多路复用器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 3:4 |
| 差分 - 输入:输出： | 无/无 |
| 输入： | LVCMOS，LVTTL，晶体 |
| 输出： | LVCMOS，LVTTL |
| 频率 - 最大： | 200MHz |
| 电源电压： | 2.375 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 16-TSSOP |
| 包装： | 带卷 (TR) |
| 其它名称： | 83904AG-02LFT |
ICS83940AG-02 REVISION A SEPTEMBER 3, 2010
1
2010 Integrated Device Technology, Inc.
Low Skew, 1-to-4, Crystal-to-LVCMOS/
LVTTL Fanout Buffer
ICS83904-02
DATA SHEET
FEATURES
Four LVCMOS/LVTTL outputs,
19
Ω typical output impedance @ V
DD = VDDO = 3.3V
Two Crystal oscillator input pairs
One LVCMOS/LVTTL clock input
Crystal input frequencry range: 12MHz – 38.88MHz
Output frequency: 200MHz (maximum)
Output Skew: 40ps (maximum) @ V
DD = VDDO = 3.3V
RMS phase jitter @ 25MHz output, using a 25MHz crystal
(100Hz – 1MHz): 0.16ps (typical) @ V
DD = VDDO = 3.3V
RMS phase noise at 25MHz:
Offset
Noise Power
100Hz ............. -118.4 dBc/Hz
1kHz ............. -141.5 dBc/Hz
10kHz ............. -157.2 dBc/Hz
100kHz ............. -157.2 dBc/Hz
Supply Voltage Modes:
(Core/Output)
3.3V/3.3V
3.3V/2.5V
3.3V/1.8V
2.5V/2.5V
2.5V/1.8V
0°C to 70°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
GENERAL DESCRIPTION
The ICS83904-02 is a low skew, high performance 1-to-4 Crystal-
to-LVCMOS Fanout Buffer. The ICS83904-02 has selectable
single-ended clock or two crystal-oscillator inputs. There is an
output enable to disable the outputs by placing them into a high-
impedance state.
Guaranteed output and par t-to-par t skew characteristics
make the ICS83904-02 ideal for those applications demand-
ing well defined performance and repeatability.
BLOCK DIAGRAM
OE
CLK_SEL0
CLK_SEL1
CLK
Q0
Q1
Q2
Q3
OSC
0 0
0 1
1 0
1 1
Pullup
ICS83904-02
16-Lead TSSOP
4.4mm x 5.0mm x 0.92mm
package body
G Package
Top View
Pulldown
XTAL_IN0
XTAL_OUT0
XTAL_IN1
XTAL_OUT1
Pulldown
CLK_SEL0
XTAL_OUT0
XTAL_IN0
VDD
XTAL_IN1
XTAL_OUT1
CLK_SEL1
CLK
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
VDDO
Q0
Q1
GND
Q2
Q3
VDDO
OE
PIN ASSIGNMENT
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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