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参数资料
| 型号： | ICS840004AGLFT |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 226.66 MHz, OTHER CLOCK GENERATOR, PDSO20 |
| 封装： | 6.50 X 4.40 MM, 0.92 MM HEIGHT, ROHS COMPLIANT, MO-153, TSSOP-20 |
| 文件页数： | 2/15页 |
| 文件大小： | 2686K |
| 代理商： | ICS840004AGLFT |
IDT / ICS LVCMOS FREQUENCY SYNTHESIZER
10
ICS840004AG REV B AUGUST 16, 2006
ICS840004
FEMTOCLOCKS CRYSTAL-TO-LVCMOS/LVTTL FREQUENCY SYNTHESIZER
LAYOUT GUIDELINE
Figure 4 shows a schematic example of the ICS840004. An
example of LVCMOS termination is shown in this schematic.
Additional LVCMOS termination approaches are shown in the
LVCMOS Termination Application Note. In this example, an 18pF
parallel resonant 26.5625MHz crystal is used. The C1=22pF
FIGURE 4. ICS840004 SCHEMATIC EXAMPLE
and C2=22pF are recommended for frequency accuracy. For
different board layout, the C1 and C2 may be slightly adjusted
for optimizing frequency accuracy. 1k
pullup or pulldown
resistors can be used for the logic control input pins.
VDDA
C2
22pF
VDD
VDDO=3.3V
Unused outputs can be left floating. There should be
no trace attached to unused outputs. Device
characterized and specification limits set with all
outputs terminated.
To Logic
Input
pins
C5
0.1u
C3
10uF
VDD
RU1
1K
VDD
R3
36
To Logic
Input
pins
RD1
Not Install
Zo = 50 Ohm
Set Logic
Input to
'1'
RU2
Not Install
U1
ICS840004
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
20
19
18
17
F_SEL0
nc
nXTAL_SEL
REF_CLK
OE
MR
nPLL_SEL
VDDA
nc
VDD
XTAL_OUT
XTAL_IN
GND
Q3
Q2
VDDO
F_SEL1
GND
Q0
Q1
X1
VDD
Zo = 50 Ohm
R5
100
XTAL_IN
VDD
LVCMOS
C4
0.01u
VDDO
Set Logic
Input to
'0'
C1
22pF
If not using the crystal input, it can be left
floating. For additional protection the XTAL_IN
pin can be tied to ground.
R4
100
R2
10
Logic Control Input Examples
RD2
1K
C6
0.1u
VDD
XTAL_OUT
Optional Termination
LVCMOS
VDD=3.3V
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