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参数资料
| 型号： | ICS841602AGILF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 2/16页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GENERATOR 28-TSSOP |
| 标准包装： | 48 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 类型： | 时钟发生器，多路复用器 |
| PLL： | 带旁路 |
| 输入： | LVCMOS，LVTTL，晶体 |
| 输出： | HCSL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 125MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-TSSOP（0.240"，6.10mm 宽） |
| 供应商设备封装： | 28-TSSOP |
| 包装： | 管件 |
| 其它名称： | 841602AGILF |
IDT / ICS HCSL CLOCK GENERATOR
10
ICS841602AGI REV. A JULY 10, 2008
ICS841602I
FEMTOCLOCKS CRYSTAL-TO-HCSL CLOCK GENERATOR
FIGURE 4. ICS841602I SCHEMATIC EXAMPLE
SCHEMATIC EXAMPLE
Figure 4 shows an example of ICS841602I application schematic.
In this example, the device is operated at V
DD
= 3.3V. The 18pF
parallel resonant 25MHz crystal is used. The C1 = 27pF and C2
= 27pF are recommended for frequency accuracy. For different
board layout, the C1 and C2 may be slightly adjusted for optimizing
frequency accuracy. Two examples of HCSL terminations are
shown in this schematic. The decoupling capacitors should be
located as close as possible to the power pin.
RD1
Not I nstall
To Logic
Input
pins
C8
.1uf
X1
25MH z
VDD
BY PASS
RD2
1K
TL3
Zo = 50
To Logic
Input
pins
(U1:24)
R5
50
TL1
Zo = 50
Recommended for PCI
Express Point-to-Point
Connection
RU1
1K
C1
27pF
+
-
REF_SEL
R4
33
Set Logic
Input to
'0'
VDD
R1
10
U1
ICS841602I
1
2
3
4
5
6
7
8
9
10
19
20
21
22
23
24
28
27
26
25
11
12
18
17
13
14
16
15
REF_SEL
REF_IN
VD D
GN D
XTAL_IN
XTAL_OUT
MR _nOE
VD D
nc
GND
Q0
nQ0
Q1
nQ1
VDD
VDDA
BY PASS
IREF
FSEL
nc
GN D
VD D
nc
C5
.1uf
18pF
HCSL Termination
VDD=3.3V
R7
50
C4
0.1u
(U1:8)
VD DA
C7
.1uf
C2
27pF
VDD
Logic Control Input Examples
MR/nOE
RU2
Not Ins tall
VDD
TL4
Zo = 50
FSEL
C6
.1uf
R6
50
Set Logic
Input to
'1'
C3
10u
R8
50
(U1:3)
R2
33
TL2
Zo = 50
(U1:14)
VDD
R3
475
VDD
+
-
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VDD
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