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参数资料
| 型号： | ICS841604AGILFT |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 125 MHz, OTHER CLOCK GENERATOR, PDSO28 |
| 封装： | 6.10 X 9.70 MM, 0.92 MM HEIGHT, ROHS COMPLIANT, MO-153, TSSOP-28 |
| 文件页数： | 16/16页 |
| 文件大小： | 423K |
| 代理商： | ICS841604AGILFT |
IIDT / ICS DIFFERENTIAL CLOCK GENERATOR FOR PCI EXPRESS
9
ICS841604AGI REV. A SEPTEMBER 4, 2007
ICS841604I
FEMTOCLOCKS DIFFERENTIAL CLOCK GENERATOR FOR PCI-EXPRESS
PRELIMINARY
FIGURE 4. ICS841604I SCHEMATIC EXAMPLE
SCHEMATIC EXAMPLE
Figure 4 shows an example of ICS841604I application schematic.
In this example, the device is operated at V
DD
= 3.3V. The 18pF
parallel resonant 25MHz crystal is used. The C1 = 27pF and C2
= 27pF are recommended for frequency accuracy. For different
board layout, the C1 and C2 may be slightly adjusted for optimizing
frequency accuracy. Two examples of HCSL terminations are
shown in this schematic. The decoupling capacitors should be
located as close as possible to the power pin.
TL3
Zo = 50
VDD
TL4
Zo = 50
VDD
C4
0.1u
VDD
+
-
VDDO=3.3V
R4
33
VDD
C8
.1uf
R6
50
VDD
FSEL
MR/nOE
C7
.1uf
RU2
Not Install
(U1:3)
R7
50
X1
25MHz
To Logic
Input
pins
C1
27pF
C3
10u
VDD
R3
475
RD1
Not Install
BY PASS
VDD
C5
.1uf
U1
ICS841604I
1
2
3
4
5
6
7
8
9
10
19
20
21
22
23
24
28
27
26
25
11
12
18
17
13
14
16
15
REF_SEL
REF_IN
VDD
GND
XTAL_IN
XTAL_OUT
MR_nOE
VDD
nc
GND
Q2
nQ2
Q3
nQ3
VDD
VDDA
BY PASS
IREF
FSEL
nc
nQ1
Q1
GND
VDD
nQ0
Q0
VDD
TL2
Zo = 50
RD2
1K
Set Logic
Input to
'0'
18pF
Recommended for PCI
Express Point-to-Point
Connection
R8
50
C2
27pF
REF_SEL
R1
10
Recommended for
PCI Express Add-In
Card
VDDA
To Logic
Input
pins
Set Logic
Input to
'1'
C6
.1uf
R2
33
TL1
Zo = 50
R5
50
RU1
1K
(U1:14)
VDD
(U1:24)
+
-
VDD=3.3V
(U1:8)
HCSL Termination
Logic Control Input Examples
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参数描述 |
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