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参数资料
| 型号： | ICS8422002AGILF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 2/16页 |
| 文件大小： | 0K |
| 描述： | IC SYNTHESIZER LVHSTL 20-TSSOP |
| 标准包装： | 74 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 类型： | 频率合成器 |
| PLL： | 带旁路 |
| 输入： | LVCMOS，LVTTL，晶体 |
| 输出： | LVHSTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 226.66MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 2.375 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 20-TSSOP |
| 包装： | 管件 |
| 其它名称： | 8422002AGILF |
ICS8422002AGI REVISION A AUGUST 12, 2009
10
2009 Integrated Device Technology, Inc.
ICS8422002I Data Sheet
FEMTOCLOCK CRYSTAL-TO-LVHSTL FREQUENCY SYNTHESIZER
Schematic Example
Figure 4 shows an example of the ICS8422002I application
schematic. In this example, the device is operated at VDD = 3.3V.
Both input options are shown. The device can either be driven using
a quartz crystal or a 3.3V LVCMOS signal. The C1 = 22pF and C2 =
22pF are recommended for frequency accuracy. For different board
layouts, the C1 and C2 may be slightly adjusted for optimizing
frequency. The LVHSTL output driver termination examples are
shown in this schematic. The decoupling capacitors should be
located as close as possible to the power pin.
Figure 4. ICS8422002I LVHSTL Schematic Example
nQ0
R5
50
C5
0.1uF
Zo = 50 Ohm
C8
0.1uF
Zo = 50 Ohm
nQ1
VDD=3.3V
1 8 p F
RD2
1K
Q1
VDD
R2
50
RD1
Not Install
(U1-16)
Zo = 50 Ohm
(U1-10)
nPLL_SEL
F_SEL0
Zo = 50 Ohm
VDD
C4
0.01u
R6
43
Logic Control Input Examples
To Logic
Input
pins
(U1-2)
U1
ICS8422002I
1 2 3 4 5 6 7 8 9 10
11
12
13
14
15
16
20 19 18 17
nc
V
DDO
Q0 nQ
0
MR
nPLL
_SEL
nc
V
DDA
F_
S
E
L0
VD
D
F
_SEL1
XT
AL
_O
U
T
XT
AL
_I
N
TE
S
T_
C
LK
nXT
AL_
SE
L
VD
D
VD
D
O
Q1 nQ
1
GN
D
RU1
1K
VDDO=3.3V
C6
0.1uF
Q1
R3
10
X1
26.5625MHz
Set Logic
Input to
'1'
Q0
C3
10uF
Set Logic
Input to
'0'
C7
0.1uF
RU2
Not Install
R1
50
R4
50
Zo = 50 Ohm
MR
+
-
VDD
VDDO
VDD
Ro ~ 7 Ohm
Q1
Driv er_LVCMOS
nQ1
VDD
VDDO
VDD
VDDA
C2
22pF
(U1-20)
C1
22pF
To Logic
Input
pins
VDD
nXTAL_SEL
+
-
F_SEL1
VDDO
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