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参数资料
| 型号： | ICS843051AGLF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/17页 |
| 文件大小： | 0K |
| 描述： | IC CLK GEN GIG ETH LVPECL 8TSSOP |
| 特色产品： | Gigabit Ethernet Clock Synthesizer |
| 标准包装： | 96 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 类型： | 时钟/频率合成器，时钟发生器 |
| PLL： | 是 |
| 输入： | 晶体 |
| 输出： | LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 161.13MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 8-TSSOP |
| 包装： | 管件 |
| 产品目录页面： | 1250 (CN2011-ZH PDF) |
| 其它名称： | 800-1136 800-1136-5 800-1136-ND 843051AGLF |
DATA SHEET
ICS843051AG REVISION A OCTOBER 13, 2010
1
2010 Integrated Device Technology, Inc.
FemtoClock Crystal-to-3.3V LVPECL
Clock Generator
ICS843051
General Description
The ICS843051 is a Gigabit Ethernet Clock Generator. The
ICS843051can synthesize 10 Gigabit Ethernet, SONET, or Serial
ATA reference clock frequencies with the appropriate choice of
crystal and output divider. The ICS843051 has excellent phase jitter
performance and is packaged in a small 8-pin TSSOP, making it
ideal for use in systems with limited board space.
Features
One differential 3.3V LVPECL output
Crystal oscillator interface designed for 18pF parallel resonant
crystals
RMS phase jitter at:
155.52MHz (12kHz – 20MHz): 0.74ps (typical)
156.25MHz (1.875MHz – 20MHz): 0.43ps (typical)
161.13MHz (1.933Hz – 20MHz): 0.43ps (typical)
Offset
Noise Power
100Hz
-95 dBc/Hz
1kHz
-110 dBc/Hz
10kHz
-125 dBc/Hz
100kHz
-125 dBc/Hz
Full 3.3V output supply mode
0°C to 70°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
Frequency Table
Inputs
Output Frequency Range (MHz)
Crystal Frequency (MHz)
FREQ_SEL
20.141601
0
161.132812
20.141601
1
80.566406
19.53125
0
156.25
19.53125
1
78.125
19.44
0
155.52
19.44
1
77.76
18.75
0
150
18.75
1
75
1
2
3
4
8
7
6
5
VCCA
VEE
XTAL_OUT
XTAL_IN
VCC
Q0
nQ0
FREQ_SEL
Pin Assignment
ICS843051
8 Lead TSSOP
4.40mm x 3.0mm x 0.925 package body
G Package
Top View
Phase
Detector
VCO
0 ÷4 (default)
1 ÷8
÷32
(fixed)
Q0
nQ0
XTAL_IN
XTAL_OUT
OSC
Block Diagram
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PDF描述 |
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