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参数资料
| 型号： | ICS8430AY-61LFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/21页 |
| 文件大小： | 0K |
| 描述： | IC SYNTHESIZER LVPECL 32-LQFP |
| 标准包装： | 1,000 |
| 系列： | HiPerClockS™ |
| 类型： | 频率合成器 |
| PLL： | 带旁路 |
| 输入： | 晶体 |
| 输出： | LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:2 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 500MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-LQFP |
| 供应商设备封装： | 32-TQFP（7x7） |
| 包装： | 带卷 (TR) |
| 其它名称： | 8430AY-61LFT |
8430AY-61
www.idt.com
REV. D JULY 27, 2010
1
ICS8430-61
500MHZ, CRYSTAL-TO-3.3V, 2.5V DIFFERENTIAL
LVPECL FREQUENCY SYNTHESIZER
GENERAL DESCRIPTION
The ICS8430-61 is a general purpose, dual output
Crystal-to-3.3V, 2.5V Differential LVPECL High Frequency
Synthesizer. The ICS8430-61 has a selectable TEST_CLK or
crystal inputs. The VCO operates at a frequency range of
250MHz to 500MHz. The VCO frequency is programmed in
steps equal to the value of the input reference or crystal
frequency. The VCO and outputfrequency can be programmed
using the serial or parallel interfaces to the configuration logic.
Frequency steps as small as 1MHz can be achieved using a
16MHz crystal or TEST_CLK.
BLOCK DIAGRAM
PIN ASSIGNMENT
FEATURES
Dual differential 3.3V or 2.5V LVPECL outputs
Selectable crystal oscillator interface
or LVCMOS/LVTTL TEST_CLK
Output frequency range: 20.83MHz to 500MHz
Crystal input frequency range: 14MHz to 27MHz
VCO range: 250MHz to 500MHz
Parallel or serial interface for programming counter
and output dividers
RMS period jitter: 6ps (maximum)
Cycle-to-cycle jitter: 30ps (maximum)
Full 3.3V supply or 3.3V core/2.5V output supply
0°C to 70°C ambient operating temperature
Available in both standard and lead-free RoHS compliant
packages
32 31 30 29 28 27 26 25
9
10 11 12 13 14 15 16
1
2
3
4
5
6
7
8
24
23
22
21
20
19
18
17
XTAL_OUT
TEST_CLK
XTAL_SEL
VCCA
S_LOAD
S_DATA
S_CLOCK
MR
M5
M6
M7
M8
N0
N1
N2
VEE
V
EE
nFOUT0
FOUT0
V
CCO
nFOUT1
FOUT1
V
CC
TEST
XTAL_IN
nP_LOAD
VCO_SEL
M0
M1
M2
M3
M4
32-Lead LQFP
7mm x 7mm x 1.4mm package body
Y Package
Top View
OSC
VCO_SEL
XTAL_SEL
TEST_CLK
XTAL_IN
XTAL_OUT
S_LOAD
S_DATA
S_CLOCK
nP_LOAD
M0:M8
N0:N2
VCO
PLL
FOUT0
nFOUT0
FOUT1
nFOUT1
TEST
÷1
÷1.5
÷2
÷3
÷4
÷6
÷8
÷12
CONFIGURATION
INTERFACE
LOGIC
÷ M
0
1
0
1
÷ 16
PHASE DETECTOR
ICS8430-61
MR
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PDF描述 |
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