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参数资料
| 型号： | ICS8430S07AKILFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 14/26页 |
| 文件大小： | 0K |
| 描述： | IC CLK GENERATOR PLL 32VFQFN |
| 标准包装： | 2,500 |
| 类型： | 时钟/频率发生器，扇出缓冲器（分配），多路复用器 |
| PLL： | 是 |
| 主要目的： | Cavium 处理器 |
| 输入： | LVCMOS，LVDS，LVPECL，LVTTL，SSTL，晶体 |
| 输出： | LVCMOS，LVPECL，LVTTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:7 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 133.33MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-VFQFN 裸露焊盘 |
| 供应商设备封装： | 32-VFQFN（5x5） |
| 包装： | 带卷 (TR) |
ICS8430S07AKI REVISION A SEPTEMBER 3, 2009
21
2009 Integrated Device Technology, Inc.
ICS8430S07I Data Sheet
CLOCK GENERATOR FOR CAVIUM PROCESSORS
3. Calculations and Equations.
The purpose of this section is to calculate the power dissipation for the LVPECL output pair.
LVPECL output driver circuit and termination are shown in Figure 9.
Figure 9. LVPECL Driver Circuit and Termination
To calculate worst case power dissipation into the load, use the following equations which assume a 50 load, and a termination voltage of
VDD – 2V.
For logic high, VOUT = VOH_MAX = VDD_MAX – 0.9V
(VDD_MAX – VOH_MAX) = 0.9V
For logic low, VOUT = VOL_MAX = VDD_MAX – 1.7V
(VDD_MAX – VOL_MAX) = 1.7V
Pd_H is power dissipation when the output drives high.
Pd_L is the power dissipation when the output drives low.
Pd_H = [(VOH_MAX – (VDD_MAX – 2V))/RL] * (VDD_MAX – VOH_MAX) = [(2V – (VDD_MAX – VOH_MAX))/RL] * (VDD_MAX – VOH_MAX) =
[(2V – 0.9V)/50
] * 0.9V = 19.8mW
Pd_L = [(VOL_MAX – (VDD_MAX – 2V))/RL] * (VDD_MAX – VOL_MAX) = [(2V – (VDD_MAX – VOL_MAX))/RL] * (VDD_MAX – VOL_MAX) =
[(2V – 1.7V)/50
] * 1.7V = 10.2mW
Total Power Dissipation per output pair = Pd_H + Pd_L = 30mW
V
OUT
V
CC
V
CC - 2V
Q1
RL
50
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