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参数资料
| 型号： | ICS84321AYI |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 260 MHz, OTHER CLOCK GENERATOR, PQFP32 |
| 封装： | 7 X 7 MM, 1.40 MM HEIGHT, MS-026, LQFP-32 |
| 文件页数： | 2/16页 |
| 文件大小： | 303K |
| 代理商： | ICS84321AYI |
84321AYI
www.icst.com/products/hiperclocks.html
REV. A OCTOBER 10, 2003
10
Integrated
Circuit
Systems, Inc.
ICS84321I
260MHZ, CRYSTAL-TO-3.3V DIFFERENTIAL
LVPECL FREQUENCY SYNTHESIZER
The schematic of the ICS84321I layout example used in this lay-
out guideline is shown in
Figure 5A. The ICS84321I recommended
PCB board layout for this example is shown in
Figure 5B. This
layout example is used as a general guideline. The layout in the
LAYOUT GUIDELINE
FIGURE 5A. SCHEMATIC OF RECOMMENDED LAYOUT
actual system will depend on the selected component types, the
density of the components, the density of the traces, and the
stack up of the P.C. board.
As in any high speed analog circuitry, the power supply pins
are vulnerable to random noise. The ICS84321I provides sepa-
rate power supplies to isolate any high switching
noise from the outputs to the internal PLL. V
CC, VCCA, and VCCO
should be individually connected to the power supply
plane through vias, and bypass capacitors should be
used for each pin. To achieve optimum jitter performance,
power supply isolation is required.
Figure 4 illustrates how
a 24
resistor along with a 10F and a .01F bypass
capacitor should be connected to each V
CCA pin.
POWER SUPPLY FILTERING TECHNIQUES
FIGURE 4. POWER SUPPLY FILTERING
24
V
CCA
10
F
.01
F
3.3V
.01
F
V
CC
R4
84
+
-
VCCA
U1
ICS84321
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
32
31
30
29
28
27
26
25
M5
M6
M7
M8
N0
N1
nc
VEE
TE
S
T
VC
C
FO
UT
1
nF
O
U
T
1
VC
C
O
FO
UT
0
nF
O
U
T
0
VE
E
MR
S_CLOCK
S_DATA
S_LOAD
VCCA
nXTAL_SEL
T_CLK
XTAL2
M4
M3
M2
M1
M0
VC
O_S
E
L
nP_L
O
A
D
XT
A
L
1
R1
125
S_CLOCK
TL2
Zo = 50 Ohm
C15
0.1u
VC
C
R7
24
FO
UT
VCC
C16
10u
IN-
R3
125
XTAL_SEL
TL1
Zo = 50 Ohm
C11
0.01u
C14
0.1u
IN+
C2
C1
S_LOAD
R2
84
S_DATA
VCC
REF_IN
FO
UTN
X1
VC
C
相关PDF资料 |
PDF描述 |
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