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参数资料
型号： ICS843252AGLFT
厂商： IDT, Integrated Device Technology Inc
文件页数： 13/16页
文件大小： 0K
描述： IC SYNTHESIZER LVPECL 16-TSSOP
标准包装： 2,500
系列： HiPerClockS™, FemtoClock™
类型： 频率合成器
PLL： 是
输入： 晶体
输出： LVPECL
电路数： 1
比率 - 输入:输出： 1:2
差分 - 输入:输出： 无/是
频率 - 最大： 625MHz
除法器/乘法器： 是/无
电源电压： 3.135 V ~ 3.465 V
工作温度： 0°C ~ 70°C
安装类型： 表面贴装
封装/外壳： 16-TSSOP（0.173"，4.40mm 宽）
供应商设备封装： 16-TSSOP
包装： 带卷 (TR)
其它名称： 843252AGLFT
ICS843252
FEMTOCLOCKTM CRYSTAL-TO- 3.3V LVPECL FREQUENCY SYNTHESIZER
IDT / ICS 3.3V LVPECL FREQUENCY SYNTHESIZER
6
ICS843252AG REV. A NOVEMBER 3, 2008
Table 4C. LVPECL DC Characteristics, VCC = VCCO_A = VCCO_B = 3.3V ± 5%, VEE = 0V, TA = 0°C to 70°C
NOTE 1: Output termination with 50
to V
CCO_A, _B – 2V.
Table 5. Crystal Characteristics
NOTE: Characterized using an 18pF parallel resonant crystal.
AC Electrical Characteristics
Table 6. AC Characteristics, VCC = VCCO_A = VCCO_B = 3.3V ± 5%, VEE = 0V, TA = 0°C to 70°C
NOTE: Electrical parameters are guaranteed over the specified ambient operating temperature range, which is established when the
device is mounted in a test socket with maintained transverse airflow greater than 500 lfpm. The device will meet specifications after
thermal equilibrium has been reached under these conditions.
NOTE 1: Defined as skew between outputs at the same supply voltages and with equal load conditions. Measured at the output
differential cross points.
NOTE 2: This parameter is defined in accordance with JEDEC Standard 65.
NOTE 3: Please refer to the Phase Noise Plots.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
VOH
Output High Voltage; NOTE 1
VCCO_X – 1.4
VCCO_X – 0.9
V
VOL
Output Low Voltage; NOTE 1
VCCO_X – 2.0
VCCO_X – 1.7
V
VSWING
Peak-to-Peak Output Voltage Swing
0.6
1.0
V
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
Mode of Oscillation
Fundamental
Frequency
FB_SEL = ÷25
19.6
27.2
MHz
FB_SEL = ÷32
15.313
21.25
MHz
Equivalent Series Resistance (ESR)
50
Shunt Capacitance
7pF
Drive Level
1mW
Parameter
Symbol
Test Conditions
Minimum
Typical
Maximum
Units
fOUT
Output Frequency Range
Output Divider = ÷ 1
490
680
MHz
Output Divider = ÷ 2
245
340
MHz
Output Divider = ÷ 3
163.33
226.67
MHz
Output Divider = ÷ 4
122.5
170
MHz
Output Divider = ÷ 5
98
136
MHz
Output Divider = ÷8
61.25
85
MHz
tsk(o)
Output Skew; NOTE 1, 2
Outputs @ Same Frequency
80
ps
Outputs @ Different Frequencies
190
ps
tjit()
RMS Phase Jitter, (Random);
NOTE 3
625MHz, (1.875MHz – 20MHz)
0.36
ps
312.5MHz, (1.875MHz – 20MHz)
0.43
ps
156.25MHz, (1.875MHz – 20MHz)
0.47
ps
125MHz, (1.875MHz – 20MHz)
0.47
ps
tR / tF
Output Rise/Fall Time
20% to 80%
300
700
ps
odc
Output Duty Cycle
47
53
%
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