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参数资料
| 型号： | ICS84330CV-01LFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 14/19页 |
| 文件大小： | 0K |
| 描述： | IC SYNTHESIZER 700MHZ 28-PLCC |
| 标准包装： | 500 |
| 系列： | HiPerClockS™ |
| 类型： | 频率合成器 |
| PLL： | 是 |
| 输入： | 晶体 |
| 输出： | LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 700MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-LCC（J 形引线） |
| 供应商设备封装： | 28-PLCC（11.5x11.5） |
| 包装： | 带卷 (TR) |
| 其它名称： | 84330CV-01LFT |
ICS84330-01 Data Sheet
700MHZ, LOW JITTER, CRYSTAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER
ICS84330CM-01 REVISION A FEBRUARY 23, 2010
4
2010 Integrated Device Technology, Inc.
Function Tables
Table 3A. Parallel and Serial Mode Function Table
NOTE:
L = LOW
H = HIGH
X = Don’t care
↑ = Rising edge transition
↓ = Falling edge transition
Table 3B. Programmable VCO Frequency Function Table
NOTE 1: These M divide values and the resulting frequencies correspond to a TEST_CLK or crystal frequency of 16MHz.
Inputs
Conditions
nP_LOAD
M
N
S_LOAD
S_CLOCK
S_DATA
X
Reset. M and N bits are all set HIGH.
L
Data
X
Data on M and N inputs passed directly to the M divider and
N output divider. TEST mode 000.
↑
Data
L
X
Data is latched into input registers and remains loaded until next
LOW transition or until a serial event occurs.
HX
X
L
↑
Data
Serial input mode. Shift register is loaded with data on S_DATA
on each rising edge of S_CLOCK.
HX
X
↑
LData
Contents of the shift register are passed to the M divider and
N output divider.
HX
X
↓
L
Data
M divider and N output divider values are latched.
H
X
L
X
Parallel or serial input do not affect shift registers.
HX
X
H
↑
Data
S_DATA passed directly to M divider as it is clocked.
VCO Frequency
(MHz)
M Divide
256
128
64
32
16
8
4
2
1
M8
M7
M6
M5
M4
M3
M2
M1
M0
250
125
001
1
111
0
1
252
126
001
1
111
1
0
254
127
001
1
111
0
1
256
128
010
0
000
1
0
696
348
101
0
111
0
698
349
101
0
111
0
1
700
350
101
0
111
1
0
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