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参数资料
| 型号： | ICS843S1333DGLF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 14/14页 |
| 文件大小： | 0K |
| 描述： | IC CLK SYNTHESIZER 8TSSOP |
| 标准包装： | 96 |
| 系列： | HiPerClockS™ |
| 类型： | 时钟/频率合成器 |
| PLL： | 是 |
| 输入： | 晶体 |
| 输出： | LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 1.333GHz |
| 除法器/乘法器： | 无/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 8-TSSOP |
| 包装： | 管件 |
ICS843S1333DG REVISION A MAY 6, 2010
9
2010 Integrated Device Technology, Inc.
ICS843S1333D Data Sheet
CRYSTAL-TO-3.3V LVPECL CLOCK SYNTHESIZER
Schematic Example
Figure 5 shows an example of the ICS843S133D application
schematic. In this example, the device is operated at VCC = 3.3V. The
18pF parallel resonant 20MHz crystal is used. The C1 and C2 = 28pF
are recommended for frequency accuracy. For different board layout,
the C1 and C2 may be slightly adjusted for optimizing frequency
accuracy. Two examples of LVPECL termination are shown in this
schematic. Additional termination approaches are shown in the
LVPECL Termination Application Note.
Figure 5. ICS843S1333D Schematic Example
R4
82.5
Set Logic
Input to
'0'
VCCA
C1
28pF
+
-
1 8 p F
VCC
C2
28pF
C5
0.01u
Zo = 50 Ohm
OE
Zo = 50 Ohm
VCC=3.3V
R3
133
RU1
1K
VCC
Set Logic
Input to
'1'
R5
82.5
XTAL_IN
Logic Control Input Examples
C4
10uF
RD2
1K
VCC
XTAL_OUT
Optional
Y-Termination
+
-
R6
50
nQ
3.3V
Zo = 50 Ohm
RD1
Not Install
R8
50
R2
133
R7
50
Zo = 50 Ohm
C3
0.01u
To Logic
Input
pins
X1
20MHz
To Logic
Input
pins
R1
10
RU2
Not Install
U1
1
2
3
4
8
7
6
5
VCCA
VEE
XTAL_OUT
XTAL_IN
VCC
Q
nQ
OE
Q
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PDF描述 |
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