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参数资料
| 型号： | ICS844001AGILF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 226.66 MHz, OTHER CLOCK GENERATOR, PDSO8 |
| 封装： | 4.40 X 3 MM, 0.925 MM HEIGHT, GREEN, MO-153, TSSOP-8 |
| 文件页数： | 11/13页 |
| 文件大小： | 648K |
| 代理商： | ICS844001AGILF |
IDT / ICS FEMTOCLOCKS CLOCK GENERATOR
7
ICS844001I REV A AUGUST 29, 2006
ICS844001I
FEMTOCLOCKS CRYSTAL-TO-LVDS CLOCK GENERATOR
APPLICATION INFORMATION
Figure 2. CRYSTAL INPUt INTERFACE
CRYSTAL INPUT INTERFACE
The ICS844001I has been characterized with 18pF parallel
resonant crystals. The capacitor values, C1 and C2, shown in
Figure 2 below were determined using a 26.5625MHz, 18pF
parallel resonant crystal and were chosen to minimize the ppm
error. The optimum C1 and C2 values can be slightly adjusted for
different board layouts.
C1
33p
X1
18pF Parallel Crystal
C2
27p
XTAL_OUT
XTAL_IN
POWER SUPPLY FILTERING TECHNIQUES
As in any high speed analog circuitry, the power supply pins
are vulnerable to random noise. The ICS844001I provides sepa-
rate power supplies to isolate any high switching
noise from the outputs to the internal PLL. V
DD and VDDA should
be individually connected to the power supply plane through
vias, and bypass capacitors should be used for each pin. To
achieve optimum jitter performance, power supply isolation is
required.
Figure 1 illustrates how a 10
resistor along with a
10
F and a .01F bypass capacitor should be connected to
each V
DDA pin.
FIGURE 1. POWER SUPPLY FILTERING
10
V
DDA
10
F
.01
F
3.3V or 2.5V
.01
F
V
DD
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| ICS844001AGLFT | 功能描述:IC CLK GEN FIBRE CHAN 8-TSSOP RoHS:是 类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器 系列:HiPerClockS™, FemtoClock™ 标准包装:1,000 系列:- 类型:时钟/频率合成器，扇出分配 PLL:- 输入:- 输出:- 电路数:- 比率 - 输入:输出:- 差分 - 输入:输出:- 频率 - 最大:- 除法器/乘法器:- 电源电压:- 工作温度:- 安装类型:表面贴装 封装/外壳:56-VFQFN 裸露焊盘 供应商设备封装:56-VFQFP-EP（8x8） 包装:带卷 (TR) 其它名称:844S012AKI-01LFT |
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