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参数资料
| 型号： | ICS844002AG-01LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 8/15页 |
| 文件大小： | 0K |
| 描述： | IC SYNTHESIZER 2LVDS 20-TSSOP |
| 标准包装： | 74 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 类型： | 频率合成器 |
| PLL： | 带旁路 |
| 输入： | 时钟，晶体 |
| 输出： | LVDS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 170MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 2.375 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 20-TSSOP |
| 包装： | 管件 |
| 其它名称： | 844002AG-01LF |
ICS844002-01
FEMTOCLOCKS CRYSTAL-TO-LVDS FREQUENCY SYNTHESIZER
IDT / ICS LVDS FREQUENCY SYNTHESIZER
2
ICS844002AG-01 REV. A SEPTEMBER 28, 2007
Table 1. Pin Descriptions
NOTE: Pulldown refers to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Number
Name
Type
Description
1, 7
nc
Unused
No connect.
2, 20
VDDO
Power
Output supply pins.
3, 4
Q0, Q0
Output
Differential output pair. LVDS interface levels.
5
MR
Input
Pulldown
Active HIGH Master Reset. When logic HIGH, the internal dividers are reset
causing the true outputs Qx to go low and the inverted outputs Qx to go high.
When logic LOW, the internal dividers and the outputs are enabled.
LVCMOS/LVTTL interface levels.
6
PLL_SEL
Input
Pulldown
Selects between the PLL and REF_CLK as input to the dividers. When LOW,
selects PLL (PLL Enable). When HIGH, deselects the reference clock (PLL
Bypass). LVCMOS/LVTTL interface levels.
8VDDA
Power
Analog supply pin.
9,
11
FSEL0,
F_SEL1
Input
Pulldown
Frequency select pins. LVCMOS/LVTTL interface levels.
10
VDD
Power
Core supply pins.
12,
13
XTAL_OUT,
XTAL_IN
Input
Parallel resonant crystal interface. XTAL_OUT is the output,
XTAL_IN is the input.
14
REF_CLK
Input
Pulldown
Non-inverting differential clock input.
15
XTAL_SEL
Input
Pulldown
Selects between crystal or REF_CLK inputs as the PLL Reference source.
Selects XTAL inputs when LOW. Selects REF_CLK when HIGH.
LVCMOS/LVTTL interface levels.
16
nc
Unused
No connect.
17
GND
Power
Power supply ground.
18, 19
Q1, Q1
Output
Differential output pair. LVDS interface levels.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
4
pF
RPULLDOWN Input Pulldown Resistor
51
k
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PDF描述 |
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