参数资料
型号: ICS844008AY-16LF
元件分类: 时钟产生/分配
英文描述: 125 MHz, OTHER CLOCK GENERATOR, PQFP32
封装: 7 X 7 MM, 1.40 MM HEIGHT, ROHS COMPLIANT, MS-026BBA, LQFP-32
文件页数: 11/12页
文件大小: 142K
代理商: ICS844008AY-16LF
844008AY-16
www.icst.com/products/hiperclocks.html
REV. A FEBRUARY 1, 2006
8
Integrated
Circuit
Systems, Inc.
ICS844008-16
FEMTOCLOCKS CRYSTAL-TO-
LVDS FREQUENCY SYNTHESIZER
PRELIMINARY
FIGURE 3. TYPICAL LVDS DRIVER TERMINATION
3.3V LVDS DRIVER TERMINATION
A general LVDS interface is shown in Figure 3. In a 100
Ω
differential transmission line environment, LVDS drivers
require a matched load termination of 100
Ω across near
the receiver input. For a multiple LVDS outputs buffer, if
only partial outputs are used, it is recommended to termi-
nate the unused outputs.
R1
100
3.3V
100 Ohm Differential Transmission Line
3.3V
+
-
LVDS
INPUTS:
LVCMOS CONTROL PINS:
All control pins have internal pull-ups or pull-downs; additional
resistance is not required but can be added for additional
protection. A 1k
Ω resistor can be used.
RECOMMENDATIONS FOR UNUSED INPUT AND OUTPUT PINS
OUTPUTS:
LVDS
All unused LVDS output pairs can be either left floating or
terminated with 100
Ω across. If they are left floating, we
recommend that there is no trace attached.
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