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参数资料
| 型号： | ICS844021AGI-01T |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 170 MHz, OTHER CLOCK GENERATOR, PDSO8 |
| 封装： | 4.40 X 3 MM, 0.925 MM HEIGHT, MO-153, TSSOP-8 |
| 文件页数： | 7/10页 |
| 文件大小： | 467K |
| 代理商： | ICS844021AGI-01T |
844021AGI-01
www.icst.com/products/hiperclocks.html
REV. A MARCH 29, 2005
6
Integrated
Circuit
Systems, Inc.
ICS844021I-01
FEMTOCLOCKSCRYSTAL-TO- LVDS
CLOCK GENERATOR
PRELIMINARY
APPLICATION INFORMATION
Figure 2. CRYSTAL INPUt INTERFACE
CRYSTAL INPUT INTERFACE
The ICS844021I-01 has been characterized with 18pF parallel
resonant crystals. The capacitor values, C1 and C2, shown in
Figure 2 below were determined using a 25MHz, 18pF parallel
resonant crystal and were chosen to minimize the ppm error.
The optimum C1 and C2 values can be slightly adjusted for dif-
ferent board layouts.
C1
33p
X1
18pF Parallel Crystal
C2
27p
XTAL_OUT
XTAL_IN
POWER SUPPLY FILTERING TECHNIQUES
As in any high speed analog circuitry, the power supply pins
are vulnerable to random noise. The ICS844021I-01 provides
separate power supplies to isolate any high switching
noise from the outputs to the internal PLL. V
DD and VDDA should
be
individually
connected
to
the
power
supply
plane through vias, and bypass capacitors should be
used for each pin. To achieve optimum jitter performance,
power supply isolation is required.
Figure 1 illustrates how
a 10
Ω resistor along with a 10μF and a .01μF bypass
capacitor should be connected to each V
DDA pin.
FIGURE 1. POWER SUPPLY FILTERING
10
Ω
V
DDA
10
μF
.01
μF
3.3V or 2.5V
.01
μF
V
DD
相关PDF资料 |
PDF描述 |
|---|---|
| ICS844021AGI-01LFT | 170 MHz, OTHER CLOCK GENERATOR, PDSO8 |
| ICS844021AGI-01LF | 170 MHz, OTHER CLOCK GENERATOR, PDSO8 |
| ICS8521AYYLFT | LOW SKEW CLOCK DRIVER, 9 TRUE OUTPUT(S), 9 INVERTED OUTPUT(S), PQFP32 |
| ICS8525GLFT | LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 4 INVERTED OUTPUT(S), PDSO20 |
| ICS8525AGLF | LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 4 INVERTED OUTPUT(S), PDSO20 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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