参数资料
型号: ICS844071AGILF
厂商: INTEGRATED DEVICE TECHNOLOGY INC
元件分类: 时钟产生/分配
英文描述: 170 MHz, OTHER CLOCK GENERATOR, PDSO8
封装: 4.40 X 3 MM, 0.925 MM HEIGHT, MO-153, TSSOP-8
文件页数: 8/10页
文件大小: 166K
代理商: ICS844071AGILF
844071AGI
www.icst.com/products/hiperclocks.html
REV. A JULY 13, 2005
7
Integrated
Circuit
Systems, Inc.
ICS844071I
FEMTOCLOCKSCRYSTAL-TO- LVDS
CLOCK GENERATOR
PRELIMINARY
3.3V, 2.5V LVDS DRIVER TERMINATION
A general LVDS interface is shown in
Figure 3. In a 100
Ω
differential transmission line environment, LVDS drivers
require a matched load termination of 100
Ω across near
FIGURE 3. TYPICAL LVDS DRIVER TERMINATION
the receiver input. For a multiple LVDS outputs buffer, if only
partial outputs are used, it is recommended to terminate the
un-used outputs.
2.5V or 3.3V
+
-
VDD
100 Ohm Differential Transmission Line
R1
100
LVDS_Driv er
Figure 2. CRYSTAL INPUt INTERFACE
CRYSTAL INPUT INTERFACE
The ICS844071I has been characterized with 18pF parallel
resonant crystals. The capacitor values, C1 and C2, shown in
Figure 2 below were determined using a 25MHz, 18pF parallel
resonant crystal and were chosen to minimize the ppm error.
The optimum C1 and C2 values can be slightly adjusted for dif-
ferent board layouts.
C1
22p
X1
18pF Parallel Crystal
C2
33p
XTAL_OUT
XTAL_IN
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PDF描述
ICS844071AGI 170 MHz, OTHER CLOCK GENERATOR, PDSO8
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