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参数资料
| 型号： | ICS844071AGLFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 13/14页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN GIG ETH 8-TSSOP |
| 标准包装： | 2,500 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 类型： | 时钟发生器 |
| PLL： | 是 |
| 输入： | 晶体 |
| 输出： | LVDS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 170MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 2.375 V ~ 3.63 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 8-TSSOP |
| 包装： | 带卷 (TR) |
| 其它名称： | 844071AGLFT |
ICS844071AG REVISION B OCTOBER 10, 2012
8
2012 Integrated Device Technology, Inc.
ICS844071 Data Sheet
FEMTOCLOCK CRYSTAL-TO-LVDS CLOCK GENERATOR
Parameter Measurement Information, continued
Differential Output Voltage Setup
Applications Information
Power Supply Filtering Technique
As in any high speed analog circuitry, the power supply pins are
vulnerable to random noise. The ICS844071 provides separate
power supplies to isolate any high switching noise from the outputs
to the internal PLL. VDD and VDDA should be individually connected
to the power supply plane through vias, and bypass capacitors
should be used for each pin. To achieve optimum jitter performance,
power supply isolation is required. Figure 1 illustrates how a 10
resistor along with a 10
F and a 0.01F bypass capacitor should be
connected to each VDDA pin.
Figure 1. Power Supply Filtering
100
out
DC Input
V
DD
LVDS
VDD
VDDA
3.3V or 2.5V
10
10F
.01F
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PDF描述 |
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