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参数资料
| 型号： | ICS844101AGI-312T |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 312.5 MHz, OTHER CLOCK GENERATOR, PDSO16 |
| 封装： | 4.40 X 5 MM, 0.92 MM HEIGHT, MO-153, TSSOP-16 |
| 文件页数： | 13/13页 |
| 文件大小： | 170K |
| 代理商： | ICS844101AGI-312T |
844101AGI-312
www.icst.com/products/hiperclocks.html
REV. A NOVEMBER 28, 2005
9
Integrated
Circuit
Systems, Inc.
ICS844101I-312
FEMTOCLOCKS CRYSTAL-TO-LVDS
312.5MHZ FREQUENCY MARGINING SYNTHESIZER
PRELIMINARY
CRYSTAL INPUT INTERFACE
The ICS844101I-312 has been characterized with 18pF
parallel resonant crystals. The capacitor values shown in
Figure 3 below were determined using a 25MHz, 18pF
Figure 3. CRYSTAL INPUt INTERFACE
parallel resonant crystal and were chosen to minimize the
ppm error.
APPLICATION INFORMATION
As in any high speed analog circuitry, the power supply pins
are vulnerable to random noise. The ICS844101I-312 pro-
vides separate power supplies to isolate any high switch-
ing noise from the outputs to the internal PLL. V
DD, VDDA, and
V
DDO should be individually connected to the power supply
plane through vias, and bypass capacitors should be
used for each pin. To achieve optimum jitter performance,
power supply isolation is required. Figure 2 illustrates how
a 10
Ω resistor along with a 10F and a .01μF bypass
capacitor should be connected to each V
DDA. The 10Ω resis-
tor can also be replaced by a ferrite bead.
POWER SUPPLY FILTERING TECHNIQUES
FIGURE 2. POWER SUPPLY FILTERING
10
Ω
V
DDA
10
μF
.01
μF
3.3V
.01
μF
V
DD
C1
27p
X1
18pF Parallel Crystal
C2
27p
XTAL_OUT
XTAL_IN
相关PDF资料 |
PDF描述 |
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