参数资料
型号: ICS844252AG-04
元件分类: 时钟产生/分配
英文描述: 187.5 MHz, OTHER CLOCK GENERATOR, PDSO16
封装: 4.40 X 5 MM, 0.92 MM HEIGHT, MO-153, TSSOP-16
文件页数: 11/12页
文件大小: 280K
代理商: ICS844252AG-04
844252AG-04
www.icst.com/products/hiperclocks.html
REV. A JANUARY 26, 2006
8
Integrated
Circuit
Systems, Inc.
ICS844252-04
FEMTOCLOCKS CRYSTAL-TO-
LVDS CLOCK GENERATOR
PRELIMINARY
RECOMMENDATIONS FOR UNUSED OUTPUT PINS
OUTPUTS:
LVDS
All unused LVDS output pairs can be either left floating or
terminated with 100
Ω across. If they are left floating, we
recommend that there is no trace attached.
3.3V LVDS DRIVER TERMINATION
A general LVDS interface is shown in Figure 3. In a 100
Ω
differential transmission line environment, LVDS drivers
require a matched load termination of 100
Ω across near
FIGURE 3. TYPICAL LVDS DRIVER TERMINATION
the receiver input. For a multiple LVDS outputs buffer, if
only partial outputs are used, it is recommended to termi-
nate the unused outputs.
R1
100
3.3V
100 Ohm Differential Transmission Line
3.3V
+
-
LVDS
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