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参数资料
| 型号： | ICS85211AMI-03 |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 85211 SERIES, LOW SKEW CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8 |
| 封装： | 3.90 X 4.90 MM, 1.37 MM HEIGHT, MS-012, SOIC-8 |
| 文件页数： | 10/13页 |
| 文件大小： | 194K |
| 代理商： | ICS85211AMI-03 |
85211AMI-03
6
REV. B NOVEMBER 14, 2007
ICS85211I-03
LOW SKEW, 1-TO-2
DIFFERENTIAL-TO-LVHSTL FANOUT BUFFER
SCHEMATIC EXAMPLE
Figure 2 shows a schematic example of ICS85211I-03. In this
example, the input is driven by an ICS HiPerClockS LVHSTL
driver. The decoupling capacitors should be physically located
FIGURE 2. ICS85211I-03 LVHSTL BUFFER SCHEMATIC EXAMPLE
near the power pin. For ICS85211I-03, the unused outputs need
to be terminated.
APPLICATION INFORMATION
Figure 1 shows how the differential input can be wired to accept
single ended levels. The reference voltage V_REF = V
DD/2 is
generated by the bias resistors R1, R2 and C1. This bias circuit
should be located as close as possible to the input pin.The ratio
FIGURE 1. SINGLE ENDED SIGNAL DRIVING DIFFERENTIAL INPUT
of R1 and R2 might need to be adjusted to position the V_REF in
the center of the input voltage swing. For example, if the input
clock swing is only 2.5V and V
DD = 3.3V, V_REF should be 1.25V
and R2/R1 = 0.609.
WIRING THE DIFFERENTIAL INPUT TO ACCEPT SINGLE ENDED LEVELS
V_REF
R1
1K
C1
0.1u
R2
1K
Single Ended Clock Input
CLK
nCLK
VDD
R4
50
U1
ICS85211-03
1
2
3
4
8
7
6
5
Q0
nQ0
Q1
nQ1
VDD
CLK
nCLK
GND
R6
50
C1
0.1u
HiPerClockS
Unused
Output
Need To
Be
Terminated
1.8V
LVHSTL Input
+
-
Zo = 50 Ohm
R1
50
ICS
R5
50
LVHSTL
R2
50
Zo = 50 Ohm
LVHSTL Driv er
VDD=3.3V
R3
50
Zo = 50 Ohm
相关PDF资料 |
PDF描述 |
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参数描述 |
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