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参数资料
| 型号： | ICS852911AVIT |
| 元件分类： | 时钟及定时 |
| 英文描述： | 852911 SERIES, LOW SKEW CLOCK DRIVER, 9 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQCC28 |
| 封装： | 11.60 X 11.40 MM, 4.10 MM HEIGHT, PLASTIC, MS-018, LCC-28 |
| 文件页数： | 1/15页 |
| 文件大小： | 271K |
| 代理商： | ICS852911AVIT |
Integrated
Circuit
Systems, Inc.
ICS852911I
LOW SKEW, 1-TO-9
DIFFERENTIAL-TO-HSTL FANOUT BUFFER
852911AVI
www.icst.com/products/hiperclocks.html
REV. A MAY 23, 2005
1
GENERAL DESCRIPTION
The ICS852911I is a low skew, 1-to-9 Differen-
tial-to-HSTL Fanout Buffer and a member of the
HiPerClockSfamily of High Performance Clock
Solutions from ICS. The ICS852911I has two se-
lectable clock inputs which can accept most dif-
ferential input levels.
Guaranteed output skew, part-to-part skew and crossover
voltage characteristics make the ICS852911I ideal for today’s
most advanced applications, such as IA64 and static RAMs.
HiPerClockS
ICS
FEATURES
9 HSTL outputs
Selectable differential CLK, nCLK or LVPECL clock inputs
HSTL_CLK, nHSTL_CLK pair can accept the following
differential input levels: LVPECL, LVDS, HSTL, SSTL, HCSL
PECL_CLK, nPECL_CLK supports the following input types:
LVPECL, CML, SSTL
Maximum output frequency: 500MHz
Output skew: 100ps (maximum)
Part-to-part skew: 300ps (maximum)
Propagation delay: 1.7ns (maximum)
V
OH = 1.4V (maximum)
3.3V core, 1.6V to 3.6V output supply range
-40°C to 85°C ambient operating temperature
BLOCK DIAGRAM
PIN ASSIGNMENT
HSTL_CLK
nHSTL_CLK
PECL_CLK
nPECL_CLK
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
Q4
nQ4
Q5
nQ5
Q6
nQ6
Q7
nQ7
Q8
nQ8
CLK_SEL
28-Lead PLCC
11.6mm x 11.4mm x 4.1mm package body
V Package
Top View
ICS852911I
25
24
23 22
21
20
19
26
27
28
1
2
3
4
18
17
16
15
14
13
12
GND
CLK_SEL
HSTL_CLK
VDD
nHSTL_CLK
PECL_CLK
nPECL_CLK
nQ8
Q8
nQ7
V
DDO
Q7
nQ6
Q6
nQ2
Q2
nQ1
V
DDO
Q1
nQ0
Q0
Q3
nQ3
Q4
VDDO
nQ4
Q5
nQ5
5
6
7
8
9
10
11
0
1
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