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参数资料
| 型号： | ICS85310AY-01 |
| 元件分类： | 时钟及定时 |
| 英文描述： | LOW SKEW CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32 |
| 封装： | 7 X 7 MM, 1.40 MM HEIGHT, MS-026, LQFP-32 |
| 文件页数： | 1/14页 |
| 文件大小： | 133K |
| 代理商： | ICS85310AY-01 |
85310AY-01
www.icst.com/products/hiperclocks.html
REV. B MAY 29, 2002
1
Integrated
Circuit
Systems, Inc.
ICS85310-01
LOW SKEW, 1-TO-10
DIFFERENTIAL-TO-2.5V/3.3V ECL/LVPECL FANOUT BUFFER
GENERAL DESCRIPTION
The ICS85310-01 is a low skew, high perfor-
mance 1-to-10 Differential-to-2.5V/3.3V ECL/
LVPECL Fanout Buffer and a member of the
HiPerClockS family of High Performance
Clock Solutions from ICS. The CLKx, nCLKx
pairs can accept most standard differential input levels.
The ICS85310-01 is characterized to operate from either
a 2.5V or a 3.3V power supply. Guaranteed output and
part-to-part skew characteristics make the ICS85310-01
ideal for those clock distribution applications demanding
well defined performance and repeatability.
FEATURES
10 differential 2.5V/3.3V LVPECL / ECL outputs
2 selectable differential input pairs
CLKx, nCLKx pairs can accept the following differential
input levels: LVDS, LVPECL, LVHSTL, SSTL, HCSL
Maximum output frequency: 700MHz
Translates any single ended input signal to 3.3V LVPECL
levels with resistor bias on nCLK input
Output skew: 30ps (typical)
Part-to-part skew: 140ps (typical)
Propagation delay: 2ns (typical)
LVPECL mode operating voltage supply range:
V
CC = 2.375V to 3.8V, VEE = 0V
ECL mode operating voltage supply range:
V
CC = 0V, VEE = -2.375V to -3.8V
-40°C to 85°C ambient operating temperature
Pin compatible with MC100LVEP111
BLOCK DIAGRAM
PIN ASSIGNMENT
HiPerClockS
,&6
32 31 30 29 28 27 26 25
9
10 11 12 13 14 15 16
1
2
3
4
5
6
7
8
24
23
22
21
20
19
18
17
Q3
nQ3
Q4
nQ4
Q5
nQ5
Q6
nQ6
VCC
CLK_SEL
CLK0
nCLK0
nc
CLK1
nCLK1
VEE
V
CCO
Q7
nQ7
Q8
nQ8
Q9
nQ9
V
CCO
V
CCO
nQ2
Q2
nQ1
Q1
nQ0
Q0
V
CCO
32-Lead LQFP
7mm x 7mm x 1.4mm package body
Y Package
Top View
ICS85310-01
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
Q4
nQ4
Q5
nQ5
Q6
nQ6
Q7
nQ7
Q8
nQ8
Q9
nQ9
CLK0
nCLK0
0
1
CLK1
nCLK1
CLK_SEL
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PDF描述 |
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