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参数资料
| 型号： | ICS85314BMI-01LFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/20页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK BUFFER MUX 2:5 20-SOIC |
| 标准包装： | 1,000 |
| 系列： | HiPerClockS™ |
| 类型： | 扇出缓冲器（分配），多路复用器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:5 |
| 差分 - 输入:输出： | 是/是 |
| 输入： | HCSL，LVCMOS，LVDS，LVHSTL，LVPECL，LVTTL，SSTL |
| 输出： | LVPECL |
| 频率 - 最大： | 700MHz |
| 电源电压： | 2.375 V ~ 3.8 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 20-SOIC |
| 包装： | 带卷 (TR) |
| 其它名称： | 85314BMI-01LFT |
85314BGI-01
www.idt.com
REV. F JULY 25, 2010
1
ICS85314I-01
LOW SKEW, 1-TO-5
DIFFERENTIAL-TO-2.5V/3.3V LVPECL FANOUT BUFFER
GENERAL DESCRIPTION
The ICS85314I-01 is a low skew, high performance 1-to-5
Differential-to-2.5V/3.3V LVPECL Fanout Buffer.The
ICS85314I-01 has two selectable clock inputs. The CLK0,
nCLK0 pair can accept most standarddifferential input
levels. The single-ended CLK1 can accept LVCMOS or
LVTTL input levels. The clock enable is internally
synchronized to eliminate runt clock pulses on the outputs
during asynchronous assertion/deassertion of the
clockenable pin.
Guaranteed output and part-to-part skew characteristics
make the ICS85314I-01 ideal for those applications
demanding well defined performance and repeatability.
FEATURES
5 differential 2.5V/3.3V LVPECL outputs
Selectable differential CLK0, nCLK0 or LVCMOS inputs
CLK0, nCLK0 pair can accept the following differential
input levels: LVPECL, LVDS, LVHSTL, HCSL, SSTL
CLK1 can accept the following input levels:
LVCMOS or LVTTL
Maximum output frequency: 700MHz
Translates any single-ended input signal to 3.3V
LVPECL levels with resistor bias on nCLK input
Output skew: 30ps (maximum), TSSOP package
50ps (maximum), SOIC package
Part-to-part skew: 350ps (maximum)
Propagation delay: 1.8ns (maximum)
RMS phase jitter @ 155.52MHz (12kHz - 20MHz):
0.05ps (typical)
LVPECL mode operating voltage supply range:
V
CC = 2.375V to 3.8V, VEE = 0V
-40°C to 85°C ambient operating temperature
Available in both standard and lead-free RoHS-compliant
packages
BLOCK DIAGRAM
PIN ASSIGNMENT
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
Q4
nQ4
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
VCC
nCLK_EN
VCC
nc
CLK1
CLK0
nCLK0
nc
CLK_SEL
VEE
ICS85314I-01
20-Lead TSSOP
6.5mm x 4.4mm x 0.92mm Package Body
G Package
Top View
ICS85314I-01
20-Lead SOIC
7.5mm x 12.8mm x 2.3mm Package Body
M Package
Top View
CLK0
nCLK0
CLK1
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
Q4
nQ4
0
1
nCLK_EN
CLK_SEL
D
Q
LE
0
1
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