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参数资料
| 型号： | ICS8535AG-01T |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 8535 SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20 |
| 封装： | 4.40 X 6.50 MM, 0.92 MM HEIGHT, MO-153, TSSOP-20 |
| 文件页数： | 1/17页 |
| 文件大小： | 375K |
| 代理商： | ICS8535AG-01T |
LOW SKEW, 1-to-4 LVCMOS/LVTTL-TO-
3.3V LVPECL FANOUT BUFFER
ICS8535-01
IDT / ICS 3.3V LVPECL FANOUT BUFFER
1
ICS8535AG-01 REV. F APRIL 12, 2007
GENERAL DESCRIPTION
The ICS8535-01 is a low skew, high performance
1-to-4 LVCMOS/LVTTL-to-3.3V LVPECL fanout
buffer and a member of the HiPerClockS family
of High Performance Clock Solutions from IDT. The
ICS8535-01 has two single ended clock inputs. the
single ended clock input accepts LVCMOS or LVTTL input lev-
els and translate them to 3.3V LVPECL levels. The clock en-
able is internally synchronized to eliminate runt clock pulses
on the output during asynchronous assertion/deassertion of
the clock enable pin.
Guaranteed output and part-to-part skew characteristics make
the ICS8535-01 ideal for those applications demanding well
defined performance and repeatability.
FEATURES
Four differential 3.3V LVPECL outputs
Selectable CLK0 or CLK1 inputs for redundant
and multiple frequency fanout applications
CLK0 or CLK1 can accept the following input levels: LVCMOS
or LVTTL
Maximum output frequency: 266MHz
Translates LVCMOS and LVTTL levels to
3.3V LVPECL levels
Output skew: 30ps (maximum)
Part-to-part skew: 250ps (maximum)
Propagation delay: 1.9ns (maximum)
Additve phase jitter, RMS: < 0.09ps (typical)
3.3V operating supply
0°C to 70°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
BLOCK DIAGRAM
PIN ASSIGNMENT
HiPerClockS
ICS
ICS8535-01
20-Lead TSSOP
4.4mm x 6.5mm x 0.92mm body package
G Package
Top View
VEE
CLK_EN
CLK_SEL
CLK0
nc
CLK1
nc
VCC
1
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Q0
nQ0
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Q2
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Q3
nQ3
CLK0
CLK1
Q0
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Q1
nQ1
Q2
nQ2
Q3
nQ3
0
1
CLK_EN
CLK_SEL
D
Q
LE
ICS8535-01
20-Lead VFQFN
4mm x 4mm x 0.9mm body package
K Package
Top View
VCC
nQ3
Q3
VEE
CLK_EN
VCC
Q2
nQ2
VCC
nc
CLK_SEL
CLK0
nc
CLK1
nc
Q0
nQ0
Q1
N
Q1
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CC
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