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参数资料
| 型号： | ICS8535AGI-31LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 9/15页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK BUFFER MUX 2:4 20-TSSOP |
| 标准包装： | 74 |
| 系列： | HiPerClockS™ |
| 类型： | 扇出缓冲器（分配），多路复用器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:4 |
| 差分 - 输入:输出： | 无/是 |
| 输入： | LVCMOS，LVTTL，晶体 |
| 输出： | LVPECL |
| 频率 - 最大： | 266MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 20-TSSOP |
| 包装： | 管件 |
| 其它名称： | 800-1960-5 8535AGI-31LF ICS8535AGI-31LF-ND |
ICS8535I-31
LOW SKEW, 1-TO-4, CRYSTAL OSCILLATOR/LVCMOS-TO-3.3V LVPECL FANOUT BUFFER
ICS8535AGI-31 REVISION A JANUARY 27, 2010
3
2010 Integrated Device Technology, Inc.
Function Tables
Table 3A. Control Input Function Table
After CLK_EN switches, the clock outputs are disabled or enabled following a rising and falling input clock or crystal oscillator edge as shown
in Figure 1. In the active mode, the state of the outputs are a function of the CLK input as described in Table 3B.
Figure 1. CLK_EN Timing Diagram
Table 3B. Clock Input Function Table
Inputs
Outputs
CLK_EN
CLK_SEL
Selected Source
Q0:Q3
nQ0:nQ3
0
CLK0
Disabled; Low
Disabled; High
0
1
CLK1
Disabled; Low
Disabled; High
1
0
CLK0
Enabled
1
CLK1
Enabled
Inputs
Outputs
CLK
Q0:Q3
nQ0:nQ3
0LOW
HIGH
1HIGH
LOW
CLK
CLK_EN
nQ0:nQ3
Q0:Q3
Enabled
Disabled
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PDF描述 |
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