参数资料
型号: ICS854104AGILF
厂商: IDT, Integrated Device Technology Inc
文件页数: 15/15页
文件大小: 0K
描述: IC CLK BUFFER 1:4 700MHZ 16TSSOP
标准包装: 96
系列: HiPerClockS™
类型: 扇出缓冲器(分配)
电路数: 1
比率 - 输入:输出: 1:4
差分 - 输入:输出: 是/是
输入: HCSL,LVDS,LVHSTL,LVPECL,SSTL
输出: LVDS
频率 - 最大: 700MHz
电源电压: 3.135 V ~ 3.465 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 16-TSSOP(0.173",4.40mm 宽)
供应商设备封装: 16-TSSOP
包装: 管件
其它名称: ICS854104AGILF-ND
ICS854104AGI REVISION B JANUARY 30, 2014
9
2014 Integrated Device Technology, Inc.
ICS854104I DATA SHEET
LOW SKEW, 1-TO-4, DIFFERENTIAL-TO-LVDS FANOUT BUFFER
Differential Clock Input Interface
The CLK /nCLK accepts LVDS, LVPECL, LVHSTL, SSTL, HCSL and
other differential signals. Both signals must meet the VPP and VCMR
input requirements. Figures 2A to 2F show interface examples for the
CLK/nCLK input driven by the most common driver types. The input
interfaces suggested here are examples only. Please consult with the
vendor of the driver component to confirm the driver termination
requirements. For example, in Figure 2A, the input termination
applies for IDT open emitter LVHSTL drivers. If you are using an
LVHSTL driver from another vendor, use their termination
recommendation.
2A. CLK/nCLK Input Driven by an IDT
Open Emitter LVHSTL Driver
Figure 2C. CLK/nCLK Input Driven by a
3.3V LVPECL Driver
Figure 2E. CLK/nCLK Input Driven by a
3.3V HCSL Driver
Figure 2B. CLK/nCLK Input Driven by a
3.3V LVPECL Driver
Figure 2D. CLK/nCLK Input Driven by a 3.3V LVDS Driver
Figure 2F. CLK/nCLK Input Driven by a 2.5V SSTL Driver
R1
50
Ω
R2
50
Ω
1.8V
Zo = 50
Ω
Zo = 50
Ω
CLK
nCLK
3.3V
LVHSTL
IDT
LVHSTL Driver
Differential
Input
3.3V
CLK
nCLK
3.3V
LVPECL
Differential
Input
HCSL
*R3
*R4
CLK
nCLK
3.3V
Differential
Input
CLK
nCLK
Differential
Input
LVPECL
3.3V
Zo=50
Ω
Zo=50
Ω
3.3V
R1
50
Ω
R2
50
Ω
R2
50
Ω
3.3V
R1
100
Ω
LVDS
CLK
nCLK
3.3V
Receiver
Zo=50
Ω
Zo=50
Ω
CLK
nCLK
Differential
Input
SSTL
2.5V
Zo=60
Ω
Zo=60
Ω
2.5V
3.3V
R1
120
Ω
R2
120
Ω
R3
120
Ω
R4
120
Ω
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