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参数资料
| 型号： | ICS8545AGI-02LFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/11页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK BUFFER MUX 2:4 20-TSSOP |
| 标准包装： | 2,500 |
| 系列： | HiPerClockS™ |
| 类型： | 扇出缓冲器（分配），多路复用器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:4 |
| 差分 - 输入:输出： | 无/是 |
| 输入： | LVCMOS，LVTTL |
| 输出： | LVDS |
| 频率 - 最大： | 350MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 20-TSSOP |
| 包装： | 带卷 (TR) |
DATASHEET
ICS8545AGI-02 REVISION A JULY 29, 2009
1
2009 Integrated Device Technology, Inc.
Low Skew, 1-to-4 LVCMOS/LVTTL-to-LVDS
Fanout Buffer
ICS8545I-02
General Description
The ICS8545I-02 is a low skew, high performance
1-to-4 LVCMOS/LVTTL-to-LVDS Clock Fanout Buffer
and a member of the HiPerClockS family of High
Performance Clock Solutions from IDT. Utilizing Low
Voltage Differential Signaling (LVDS) the ICS8545I-02
provides a low power, low noise, solution for distributing clock signals
over controlled impedances of 100
. The ICS8545I-02 accepts an
LVCMOS/LVTTL input level and translates it to 3.3V LVDS output
levels.
Guaranteed output and part-to-part skew characteristics make the
ICS8545I-02 ideal for those applications demanding well defined
performance and repeatability.
Features
Four differential LVDS output pairs
Two LVCMOS/LVTTL clock inputs to support redundant
or selectable frequency fanout applications
Maximum output frequency: 350MHz
Translates LVCMOS/LVTTL input signals to LVDS levels
Output skew: 60ps (maximum)
Part-to-part skew: 450ps (maximum)
Propagation delay: 1.45ns (maximum)
Additive phase jitter, RMS: 0.14ps (typical)
Full 3.3V supply mode
-40°C to 85°C ambient operating temperature
Available in lead-free (RoHS 6) package
HiPerClockS
ICS
ICS8545I-02
20-Lead TSSOP
6.5mm x 4.4mm x 0.925
mm
package body
G Package
Top View
Pin Assignment
Block Diagram
0
1
nD
Q
LE
0
1
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
CLK_EN
CLK1
CLK2
CLK_SEL
OE
Pulldown
Pullup
1
2
3
4
5
6
7
8
9
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20
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18
17
16
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14
13
12
11
GND
OE
nc
CLK2
nc
CLK1
CLK_SEL
CLK_EN
GND
VDD
Q0
nQ0
VDD
Q1
nQ1
Q2
nQ2
GND
Q3
nQ3
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