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参数资料
| 型号： | ICS8545BGILF |
| 元件分类： | 时钟及定时 |
| 英文描述： | LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 4 INVERTED OUTPUT(S), PDSO20 |
| 封装： | 6.50 X 4.40 MM, 0.92MM HEIGHT, MO-153, TSSOP-20 |
| 文件页数： | 10/11页 |
| 文件大小： | 156K |
| 代理商： | ICS8545BGILF |
8545BGI
www.icst.com/products/hiperclocks.html
REV. A DECEMBER 17, 2003
8
Integrated
Circuit
Systems, Inc.
ICS8545I
LOW SKEW, 1-TO-4
LVCMOS/LVTTL-TO-LVDS FANOUT BUFFER
3.3V LVDS DRIVER TERMINATION
A general LVDS interface is shown in
Figure 2. In a 100
differ-
ential transmission line environment, LVDS drivers require a
matched load termination of 100
across near the receiver in-
FIGURE 2. TYPICAL LVDS DRIVER TERMINATION
put. For a multiple LVDS outputs buffer, if only partial outputs
are used, it is recommended to terminate the un-used outputs.
PARAMETER MEASUREMENT INFORMATION
100 Ohm Differential
R1
100
3.3V
+
-
LVDS_Driver
3.3V
Zo = 50
C2
0.1u
Zo = 50
Zo = 50 Ohm
Zo = 50
C1
0.1u
3.3V
+
-
C3
0.1u
R11
1K
Zo = 50
3.3V
U1
ICS8545I
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
20
19
18
17
GND
CLK_EN
CLK_SEL
CLK1
NC
CLK2
NC
OE
GND
VDD
nQ3
Q3
GND
nQ2
Q2
nQ1
Q0
nQ0
VDD
Q1
R13
43
Ro ~ 7 Ohm
LVCMOS
+
-
R2
50
R12
1K
R1
50
3.3V
SCHEMATIC EXAMPLE
Figure 3 shows a schematic example of the ICS8545I. In this
example, the CLKx input is selected. The decoupling capacitors
should be physically located near the power pin. For ICS8545I, the
unused clock outputs can be left floating.
FIGURE 3. ICS8545I LVDS BUFFER SCHEMATIC EXAMPLE
相关PDF资料 |
PDF描述 |
|---|---|
| ICS8545BGILF | 8545 SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 4 INVERTED OUTPUT(S), PDSO20 |
| ICS8545BGI | 8545 SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 4 INVERTED OUTPUT(S), PDSO20 |
| ICS8545BGLF | 8545 SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20 |
| ICS8545BGT | 8545 SERIES, LOW SKEW CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20 |
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参数描述 |
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