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参数资料
| 型号： | ICS8545BGILFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 11/15页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK BUFFER MUX 2:4 20-TSSOP |
| 标准包装： | 2,500 |
| 系列： | HiPerClockS™ |
| 类型： | 扇出缓冲器（分配），多路复用器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:4 |
| 差分 - 输入:输出： | 无/是 |
| 输入： | LVCMOS，LVTTL |
| 输出： | LVDS |
| 频率 - 最大： | 650MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 20-TSSOP |
| 包装： | 带卷 (TR) |
| 其它名称： | 8545BGILFT |
ICS8545I
LOW SKEW, 1-TO-4, LVCMOS/LVTTL-TO-LVDS FANOUT BUFFER
IDT / ICS LVDS FANOUT BUFFER
5
ICS8545BGI REV. B MARCH 02, 2009
Table 4C. LVDS DC Characteristics, VDD = 3.3V ± 5%, TA = -40°C to 85°C
AC Electrical Characteristics
Table 5. AC Characteristics, VDD = 3.3V ± 5%, TA = -40°C to 85°C
All parameters measured at
≤ 650MHz unless noted otherwise.
NOTE 1: Measured from VDD/2 of the input to the differential output crossing point.
NOTE 2: Defined as skew between outputs at the same supply voltage and with equal load conditions.
Measured at VDD/2 of the input to the differential output crossing point.
NOTE 3: Defined as skew between outputs on different devices operating at the same supply voltages and with equal load conditions.
Using the same type of inputs on each device, the outputs are measured at the differential cross points.
NOTE 4: This parameter is defined in accordance with JEDEC Standard 65.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
VOD
Differential Output Voltage
200
280
360
mV
V
OD
VOD Magnitude Change
40
mV
VOS
Offset Voltage
1.125
1.25
1.375
V
OS
VOS Magnitude Change
5
25
mV
IOz
High Impedance Leakage
-10
±1
+10
A
IOFF
Power Off Leakage
-20
±1
+20
A
IOSD
Differential Output Short Circuit Current
-3.5
-5
mA
IOS
Output Short Circuit Current
-3.5
-5
mA
VOH
Output Voltage High
1.34
1.6
V
VOL
Output Voltage Low
0.9
1.06
V
Parameter
Symbol
Test Conditions
Minimum
Typical
Maximum
Units
fMAX
Output Frequency
650
MHz
tPD
Propagation Delay; NOTE 1
≤ 650MHz
1.4
3.6
ns
tjit
Buffer Additive Phase Jitter, RMS;
refer to Additive Phase Jitter Section
156.25MHz, Integration Range:
12kHz – 20MHz
0.13
ps
tsk(o)
Output Skew; NOTE 2, 4
40
ps
tsk(pp)
Part-to-Part Skew; NOTE 3, 4
500
ps
tR / tF
Output Rise/Fall Time
20% to 80% @ 50MHz
200
400
700
ps
odc
Output Duty Cycle
≤ 266MHz
45
55
%
> 266MHz
40
60
%
相关PDF资料 |
PDF描述 |
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