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参数资料
| 型号： | ICS8634BK-01T |
| 元件分类： | 时钟及定时 |
| 英文描述： | 8634 SERIES, PLL BASED CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), QCC32 |
| 封装： | 5 X 5 MM, 0.95 MM HEIGHT, MO-220, VFQFN-32 |
| 文件页数： | 1/16页 |
| 文件大小： | 280K |
| 代理商： | ICS8634BK-01T |
8634BY-01
www.icst.com/products/hiperclocks.html
REV. C NOVEMBER 12, 2004
1
Integrated
Circuit
Systems, Inc.
ICS8634-01
1-TO-5 DIFFERENTIAL-TO-3.3V LVPECL
ZERO DELAY BUFFER
GENERAL DESCRIPTION
The ICS8634-01 is a high performance 1-to-5 Dif-
ferential-to-3.3V LVPECL Zero Delay Buffer and a
member of the HiPerClockS family of High Per-
formance Clock Solutions from ICS.The ICS8634-
01 has two selectable clock inputs. The CLKx,
nCLKx pair can accept most standard differential input levels.
Utilizing one of the outputs as feedback to the PLL, output fre-
quencies up to 700MHz can be regenerated with zero delay with
respect to the input. Dual reference clock inputs support redun-
dant clock or multiple reference applications.
FEATURES
5 differential 3.3V LVPECL outputs
Selectable differential clock inputs
CLKx, nCLKx pair can accept the following differential
input levels: LVPECL, LVDS, LVHSTL, HCSL, SSTL
Output frequency range: 31.25MHz to 700MHz
Input frequency range: 31.25MHz to 700MHz
VCO range: 250MHz to 700MHz
External feedback for “zero delay” clock regeneration
Cycle-to-cycle jitter: 25ps (maximum)
Output skew: 25ps (maximum)
PLL reference zero delay: 50ps ± 100ps
3.3V operating supply
0°C to 70°C ambient operating temperature
Lead-Free package available
Industrial temperature information available upon request
HiPerClockS
ICS
BLOCK DIAGRAM
PIN ASSIGNMENT
32 31 30 29 28 27 26 25
9
10 11 12 13 14 15 16
1
2
3
4
5
6
7
8
24
23
22
21
20
19
18
17
VCCO
Q3
nQ3
Q2
nQ2
Q1
nQ1
VCCO
SEL0
SEL1
CLK0
nCLK0
CLK1
nCLK1
CLK_SEL
MR
V
CCO
Q0
nQ0
V
EE
V
EE
FB_IN
nFB_IN
V
CC
V
CCO
nQ4
Q4
V
EE
V
EE
V
CCA
PLL_SEL
V
CC
32-Lead LQFP
7mm x 7mm x 1.4mm package body
Y Package
Top View
32-Lead VFQFN
5mm x 5mm x 0.95 package body
K Package
Top View
ICS8634-01
PLL_SEL
CLK0
nCLK0
CLK1
nCLK1
CLK_SEL
FB_IN
nFB_IN
SEL0
SEL1
MR
0
1
PLL
0
1
÷4, ÷8
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
Q4
nQ4
相关PDF资料 |
PDF描述 |
|---|---|
| ICS86953AYI-147LF | PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32 |
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相关代理商/技术参数 |
参数描述 |
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